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參數資料
| 型號： | ISP1106DH |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 通用總線功能 |
| 英文描述： | GT 10C 10#16 SKT PLUG |
| 中文描述： | LINE TRANSCEIVER, PDSO16 |
| 封裝： | 4.40 MM, PLASTIC, MO-153, SOT-403-1, TSSOP-16 |
| 文件頁數： | 14/24頁 |
| 文件大小： | 588K |
| 代理商： | ISP1106DH |
Philips Semiconductors
ISP1105/1106/1107
Advanced USB transceivers
Product data
Rev. 06 — 30 November 2001
14 of 24
9397 750 08872
Koninklijke Philips Electronics N.V. 2001. All rights reserved.
[1]
[2]
Test circuit: see
Figure 11
.
Characterized only, not tested. Limits guaranteed by design.
Receiver timings (full-speed and low-speed mode)
Differential receiver
t
PLH(rcv)
propagation delay
t
PHL(rcv)
(D
+
,D
to RCV)
Single-ended receiver
t
PLH(se)
propagation delay
t
PHL(se)
(D
+
,D
to VP, VM)
LOW-to-HIGH; see
Figure 7
HIGH-to-LOW; see
Figure 7
-
-
-
-
15
15
ns
ns
LOW-to-HIGH; see
Figure 7
HIGH-to-LOW; see
Figure 7
-
-
-
-
18
18
ns
ns
Table 16:
V
CC
= 4.0 to 5.5 V or V
reg(3.3)
= 3.0 to 3.6 V; V
CC(I/O)
= 1.65 to 3.6 V; V
GND
= 0 V; see
Table 10
for valid voltage level
combinations; T
amb
=
40 to
+
85
°
C; unless otherwise specified.
Symbol
Parameter
Conditions
Dynamic characteristics: analog I/O pins (D
+
, D
)
[1]
…continued
Min
Typ
Max
Unit
Fig 5.
Rise and fall times.
Fig 6.
Timing of OE to D
+
, D
.
Fig 7.
Timing of D
+
, D
to RCV, VP, VM.
Fig 8.
Timing of VO/VPO, FSE0/VMO to D
+
, D
.
MGS963
VOL
tFR, tLR
tFF, tLF
VOH
90%
10%
10%
90%
MGS966
VOL
VOH
tPZH
tPZL
tPHZ
tPLZ
VOH
0.3 V
VOL
+
0.3 V
VCRS
0.9 V
0.9 V
1.65 V
0 V
logic input
differential
data lines
MGS965
VOL
VOH
tPHL(rcv)
tPHL(se)
tPLH(rcv)
tPLH(se)
VCRS
VCRS
0.9 V
0.9 V
2.0 V
0.8 V
logic output
differential
data lines
MGS964
VOL
VOH
tPHL(drv)
tPLH(drv)
VCRS
VCRS
0.9 V
0.9 V
1.65 V
0 V
logic input
differential
data lines
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