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參數資料
| 型號： | ISP1161A1 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Universal Serial Bus single-chip host and device controller |
| 中文描述： | 通用串行總線的單芯片主機和設備控制器 |
| 文件頁數： | 101/127頁 |
| 文件大小： | 2762K |
| 代理商： | ISP1161A1 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁當前第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁
Philips Semiconductors
ISP1161
Full-speed USB single-chip host and device controller
Product data
Rev. 01 — 3 July 2001
101 of 130
9397 750 08313
Philips Electronics N.V. 2001. All rights reserved.
After waking up from ‘suspend’ state, the firmware must unlock the registers and
FIFOs via this command, by writing the unlock code (AA37H) into the Lock Register.
The bit allocation of the Lock Register is given in
Table 98
.
Code (Hex): B0 —
unlock the device
Transaction —
write 1 word (unlock code)
14.3.3
Write/Read Scratch Register
This command accesses the 16-bit Scratch Register, which can be used by the
firmware to save and restore information, e.g., the device status before powering
down in ‘suspend’ state. The register bit allocation is given in
Table 100
.
Code (Hex): B2/B3 —
write/read Scratch Register
Transaction —
write/read 1 word
Table 98: Lock Register: bit allocation
Bit
15
Symbol
Reset
1
Access
W
Bit
7
Symbol
Reset
0
Access
W
14
13
12
11
10
9
8
UNLOCKH[7:0] = AAH
0
W
4
UNLOCKL[7:0] = 37H
1
W
0
W
6
1
W
5
1
W
3
0
W
2
1
W
1
0
W
0
0
W
1
W
0
W
1
W
1
W
1
W
Table 99: Lock Register: bit description
Bit
Symbol
15 to 0
UNLOCK[15:0]
Description
Sending data AA37H unlocks the internal registers and FIFOs
for writing, following a ‘resume’.
Table 100:Scratch Information Register: bit allocation
Bit
15
Symbol
reserved
Reset
0
Access
R/W
Bit
7
Symbol
Reset
0
Access
R/W
14
13
12
11
10
9
8
SFIRH[6:0]
0
R/W
3
0
0
0
0
0
0
R/W
6
R/W
5
R/W
4
R/W
2
R/W
1
R/W
0
SFIRL[7:0]
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 101:Scratch Information Register: bit description
Bit
Symbol
Description
15
-
reserved; must be logic 0
14 to 0
SFIR[14:0]
Scratch Information Register
相關PDF資料 |
PDF描述 |
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