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參數資料
| 型號： | ISP1161BM |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Full-speed Universal Serial Bus single-chip host and device controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 7 X 7 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-414-1, LQFP-64 |
| 文件頁數： | 113/127頁 |
| 文件大小： | 2762K |
| 代理商： | ISP1161BM |
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Philips Semiconductors
ISP1161
Full-speed USB single-chip host and device controller
Product data
Rev. 01 — 3 July 2001
113 of 130
9397 750 08313
Philips Electronics N.V. 2001. All rights reserved.
20.3.2
HC multi-cycle burst mode DMA timing
[1]
t
SLAL
+ (4 or 8)t
RC
+ t
DS
.
Table 118:Dynamic characteristics: HC multi-cycle burst mode DMA timing
Symbol
Parameter
Conditions
16-bit bus
Min
Unit
Max
Read/write timing (for 4-cycle and 8-cycle burst mode)
t
RL
WR/RD LOW pulse width
t
RHRL
WR/RD HIGH to next WR/RD
LOW
t
RC
WR/RD cycle
t
SLRL
RD/WR LOW to DREQ1 LOW
t
SHAH
RD/WR HIGH to DACK1 HIGH
t
RHAL
DREQ1 HIGH to DACK1 LOW
t
DC
DREQ1 cycle
t
DS(read)
DREQ1 pulse spacing (read)
t
DS(read)
DREQ1 pulse spacing (read)
t
DS(write)
DREQ1 pulse spacing (write)
t
DS(write)
DREQ1 pulse spacing (write)
42
60
-
-
ns
ns
102
22
> 0
> 0
-
64
-
ns
ns
ns
[1]
-
-
-
-
-
ns
4-cycle burst mode
8-cycle burst mode
4-cycle burst mode
8-cycle burst mode
105
150
62 to 84
150 to 167
ns
ns
Fig 47. HC multi-cycle burst mode DMA timing.
MGT971
tRHRL
tDS
tRHSH
DREQ1
DACK1
RD or WR
tSLRL
tSHAH
tRL
tRC
tSLAL
相關PDF資料 |
PDF描述 |
|---|---|
| ISP1181ABS | INDUCTOR 1.0NH +-.3NH FIXED SMD |
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| ISP1181B | Full-speed Universal Serial Bus peripheral controller |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| ISP1181A | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Full-speed Universal Serial Bus peripheral controller |
| ISP1181ABS | 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Full-speed Universal Serial Bus peripheral controller |
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