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參數資料
| 型號： | ISP1562BE |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Hi-Speed Universal Serial Bus PCI Host Controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-407-1, LQFP-100 |
| 文件頁數： | 65/98頁 |
| 文件大小： | 442K |
| 代理商： | ISP1562BE |
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9397 750 14223
Koninklijke Philips Electronics N.V. 2005. All rights reserved.
Product data sheet
Rev. 01 — 14 July 2005
65 of 98
Philips Semiconductors
ISP1562
USB PCI Host Controller
11.2.4
HCSP-PORTROUTE register
The HCSP-PORTROUTE (Companion Port Route Description) register is an optional
read-only field that is valid only if PRR (bit 7 in the HCSPARAMS register) is logic 1. Its
address is value read from func2 of address 10h + 0Ch.
This field is a 15-element nibble array—each 4 bits is one array element. Each array
location corresponds one-to-one with a physical port provided by the Host Controller. For
example, PORTROUTE[0] corresponds to the first PORTSC port, PORTROUTE[1] to the
second PORTSC port, and so on. The value of each element indicates to which of the
companion Host Controllers this port is routed. Only the first N_PORTS elements have
valid information. A value of zero indicates that the port is routed to the lowest numbered
function companion Host Controller. A value of one indicates that the port is routed to the
next lowest numbered function companion Host Controller, and so on.
11.3 Operational registers of Enhanced USB Host Controller
11.3.1
USBCMD register
The USB Command (USBCMD) register indicates the command to be executed by the
serial Host Controller. Writing to this register causes a command to be executed.
Table 92
shows the bit allocation.
[1]
The reserved bits should always be written with the reset value.
Table 92:
Address: Value read from func2 of address 10h + 20h
Bit
31
Symbol
Reset
0
Access
R/W
Bit
23
Symbol
Reset
0
Access
R/W
Bit
15
Symbol
Reset
0
Access
R/W
Bit
7
Symbol
LHCR
USBCMD - USB Command register bit allocation
30
29
28
27
26
25
24
reserved
[1]
0
0
0
0
0
0
0
R/W
22
R/W
21
R/W
20
R/W
19
R/W
18
R/W
17
R/W
16
ITC[7:0]
0
0
0
1
0
0
0
R/W
14
R/W
13
R/W
12
R/W
11
R/W
10
R/W
9
R/W
8
reserved
[1]
0
0
0
0
0
0
0
R/W
6
IAAD
R/W
5
ASE
R/W
4
PSE
R/W
3
R/W
2
R/W
1
HC
RESET
0
R/W
R/W
0
RS
FLS[1:0]
Reset
Access
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
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PDF描述 |
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