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參數資料
| 型號： | ISP1582 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Hi-Speed Universal Serial Bus peripheral controller |
| 中文描述： | 高速通用串行總線外設控制器 |
| 文件頁數： | 31/66頁 |
| 文件大小： | 325K |
| 代理商： | ISP1582 |
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Philips Semiconductors
ISP1582
Hi-Speed USB peripheral controller
Preliminary data
Rev. 03 — 25 August 2004
31 of 66
9397 750 13699
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
9.3 Data flow registers
9.3.1
Endpoint Index register (address: 2Ch)
The Endpoint Index register selects a target endpoint for register access by the
microcontroller. The register consists of 1 byte, and the bit allocation is shown in
Table 30
.
Bit
Symbol
Reset
Bus Reset
Access
7
6
5
4
3
2
1
0
IEVBUS
0
0
R/W
IEDMA
0
0
R/W
IEHS_STA
0
0
R/W
IERESM
0
0
R/W
IESUSP
0
0
R/W
IEPSOF
0
0
R/W
IESOF
0
0
R/W
IEBRST
0
unchanged
R/W
Table 29:
Bit
31 to 26 -
25
24
23
22
21
20
19
18
17
16
15
14
13
12
11
10
9
8
7
6
5
Interrupt Enable register: bit description
Symbol
Description
reserved
EP7TX
Logic 1 enables interrupt from the indicated endpoint.
EP7RX
Logic 1 enables interrupt from the indicated endpoint.
EP6TX
Logic 1 enables interrupt from the indicated endpoint.
EP6RX
Logic 1 enables interrupt from the indicated endpoint.
EP5TX
Logic 1 enables interrupt from the indicated endpoint.
EP5RX
Logic 1 enables interrupt from the indicated endpoint.
EP4TX
Logic 1 enables interrupt from the indicated endpoint.
EP4RX
Logic 1 enables interrupt from the indicated endpoint.
EP3TX
Logic 1 enables interrupt from the indicated endpoint.
EP3RX
Logic 1 enables interrupt from the indicated endpoint.
EP2TX
Logic 1 enables interrupt from the indicated endpoint.
EP2RX
Logic 1 enables interrupt from the indicated endpoint.
EP1TX
Logic 1 enables interrupt from the indicated endpoint.
IEP1RX
Logic 1 enables interrupt from the indicated endpoint.
IEP0TX
Logic 1 enables interrupt from the control IN endpoint 0.
IEP0RX
Logic 1 enables interrupt from the control OUT endpoint 0.
-
reserved
IEP0SETUP Logic 1 enables interrupt for the setup data received on endpoint 0.
IEVBUS
Logic 1 enables interrupt for V
BUS
sensing.
IEDMA
Logic 1 enables interrupt on DMA status change detection.
IEHS_STA
Logic 1 enables interrupt on detection of a high-speed status
change.
IERESM
Logic 1 enables interrupt on detection of a resume state.
IESUSP
Logic 1 enables interrupt on detection of a suspend state.
IEPSOF
Logic 1 enables interrupt on detection of a Pseudo SOF.
IESOF
Logic 1 enables interrupt on detection of an SOF.
IEBRST
Logic 1 enables interrupt on detection of a bus reset.
4
3
2
1
0
相關PDF資料 |
PDF描述 |
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| ISP1582BS | Hi-Speed Universal Serial Bus peripheral controller |
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