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參數資料
| 型號： | LTC3670EDDB#TRPBF |
| 廠商： | Linear Technology |
| 文件頁數： | 8/12頁 |
| 文件大小： | 210K |
| 描述： | IC REG TRPL BCK/LINEAR 12DFN |
| 標準包裝： | 2,500 |
| 拓撲： | 降壓（降壓）同步（1），線性（LDO）（2） |
| 功能： | 任何功能 |
| 輸出數： | 3 |
| 頻率 - 開關： | 2.25MHz |
| 電壓/電流 - 輸出 1： | 可調至0.8V，400mA |
| 電壓/電流 - 輸出 2： | 可調至0.8V，150mA |
| 電壓/電流 - 輸出 3： | 可調至0.8V，150mA |
| 帶 LED 驅動器： | 無 |
| 帶監控器： | 無 |
| 帶序列發生器： | 無 |
| 電源電壓： | 2.5 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 12-WFDFN 裸露焊盤 |
| 供應商設備封裝： | 12-DFN-EP（3x2） |
| 包裝： | 帶卷 (TR) |
LTC3670
8
3670f
OPERATION
Switch Slew-Rate Control
The buck regulator contains new patent-pending circuitry
to limit the slew rate of the switch node (SW pin). This
new circuitry is designed to transition the switch node
over a period of a couple nanoseconds, signi cantly
reducing radiated EMI and conducted supply noise while
maintaining high ef ciency.
LOW DROPOUT LINEAR REGULATORS (LDOs)
The LTC3670 contains two independent LDO regulators,
each supporting a load of up to 150mA. Each LDO takes
power from the V
IN
pin and drives its output pin with the
goal of bringing its feedback pin voltage to 0.8V. In the
usual case, a resistor divider is connected between the
LDOs output pin, feedback pin and ground, in order to
close the control loop and program the output voltage. For
stability, each LDO output must be bypassed to ground
with a minimum 1糉 ceramic capacitor.
Each LDO can be enabled or disabled via its own enable
pin. When disabled with V
IN
still applied, an internal
pull-down resistor is switched in to help bring the output
to ground. When an LDO is enabled, a soft-start circuit
ramps its regulation point from zero to nal value over a
period of roughly 0.1ms, reducing the required V
IN
inrush
current.
LOW V
IN
SUPPLY UNDERVOLTAGE LOCKOUT
An undervoltage lockout (UVLO) circuit shuts down the
LTC3670 when V
IN
drops below about 2.2V.
POWER GOOD DETECTION
The LTC3670 has a built-in supply monitor. If the feedback
voltage of every enabled regulator is above 92% of its
regulation value, the PGOOD pin becomes high impedance.
Otherwise, or if no regulators are enabled, the PGOOD pin
is driven to ground by an internal open-drain NMOS.
The PGOOD pin may be connected through a pull-up
resistor to a supply voltage of up to 5.5V, independent of
the V
IN
pin voltage.
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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