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參數(shù)資料
| 型號(hào)： | LTC4214-1IMS#TRPBF |
| 廠商： | Linear Technology |
| 文件頁(yè)數(shù)： | 9/32頁(yè) |
| 文件大小： | 277K |
| 描述： | IC CTRLR HOTSWAP NEGVOLT 10MSOP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 類(lèi)型： | 熱交換控制器 |
| 應(yīng)用： | 通用 |
| 內(nèi)部開(kāi)關(guān)： | 無(wú) |
| 電源電壓： | 6 V ~ 16 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 10-TFSOP，10-MSOP（0.118"，3.00mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 10-MSOP |
| 包裝： | 帶卷 (TR) |
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LTC4214-1/LTC4214-2
9
421412f
UV (Pin 9): Undervoltage Input. The active high threshold
at the UV pin is set at 2.25V with respect to V
EE
and exhibits
0.25V hysteresis. If UV < 2V, PWRGD pulls high, both
GATE and TIMER pull low. If UV rises above 2.25V, this
initiates an initial timing cycle followed by GATE start-up.
The internal UVLO at V
IN
always overrides UV. A low at UV
resets an internal fault latch. A 1nF to 10nF capacitor at UV
prevents transients and switching noise from affecting the
UV thresholds and prevents glitches at the GATE pin.
TIMER (Pin 10): Timer Input. TIMER is used to generate
an initial timing delay at start-up and to delay shutdown in
the event of an output overload (circuit breaker fault).
TIMER starts an initial timing cycle when the following
conditions are met: UV is high, OV is low, V
IN
clears UVLO,
TIMER pin is low, GATE is lower than V
GATEL
, SS < 0.2V,
and V
SENSE
V
EE
< V
CB
. A pull-up current of 5礎(chǔ) then
charges C
T
, generating a time delay. If C
T
charges to
V
TMRH
(3V), the timing cycle terminates, TIMER quickly
pulls low and GATE is activated.
If SENSE exceeds 50mV while GATE is high, a circuit
breaker cycle begins with a 40礎(chǔ) pull-up current charging
C
T
. If DRAIN is approximately 4.2V during this cycle, the
timer pull-up has an additional current of 8 " I
DRN
. If SENSE
drops below 50mV before TIMER reaches 3V, a 5礎(chǔ) pull-
down current slowly discharges the C
T
. In the event that C
T
eventually integrates up to the V
TMRH
threshold, the circuit
breaker trips, GATE quickly pulls low and PWRGD pulls
high. The LTC4214-1 TIMER pin latches high with a 5礎(chǔ)
pull-up source. This latched fault is cleared by either
pulling TIMER low with an external device or by pulling UV
below 2V. The LTC4214-2 starts a shutdown cooling cycle
following an overcurrent fault. This cycle consists of 4
discharging ramps and 3 charging ramps. The charging
and discharging currents are 5礎(chǔ) and TIMER ramps
between its 1.7V and 3V thresholds. At the completion of
a shutdown cooling cycle, the LTC4214-2 attempts a start-
up cycle.
PI FU CTIO S
U
U
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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