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參數資料
| 型號： | MC100ES6535EJR2 |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 100E SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| 封裝： | 0.65 MM PITCH, LEAD FREE, TSSOP-20 |
| 文件頁數： | 1/8頁 |
| 文件大小： | 652K |
| 代理商： | MC100ES6535EJR2 |
DATA SHEET
MPC100ES6535 REVISION 4 JUNE 9, 2009
1
2009 Integrated Device Technology, Inc.
3.3V LVCMOS-to-LVPECL 1:4 Fanout Buffer MC100ES6535
The MC100ES6535 is a low skew, high performance 3.3 V 1-to-4 LVCMOS to LVPECL
fanout buffer. The ES6535 has two selectable inputs that allow LVCMOS or LVTTL input levels
which translate to LVPECL outputs. The clock enable is internally synchronized to eliminate
runt pulses on the outputs during asynchronous assertion/deassertion of the clock enable pin.
The ES6535 is ideal for high performance clock distribution applications.
Features
4 differential LVPECL outputs
2 selectable LVCMOS/LVTTL inputs
1 GHz maximum output frequency
Translates LVCMOS/LVTTL levels to LVPECL levels
30 ps maximum output skew
190 ps part-to-part skew
3.3 V operating range
20-lead TSSOP package
Ambient temperature range –40
°C to +85°C
20-lead Pb-free package available
ORDERING INFORMATION
Device
Package
MC100ES6535DT
TSSOP-20
MC100ES6535DTR2
TSSOP-20
MC100ES6535EJ
TSSOP-20 (Pb-Free)
MC100ES6535EJR2
TSSOP-20 (Pb-Free)
DT SUFFIX
20-LEAD TSSOP PACKAGE
CASE 948E-02
EJ SUFFIX
20-LEAD TSSOP PACKAGE
Pb-FREE PACKAGE
CASE 948E-02
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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