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參數(shù)資料
| 型號： | MC68HC05PV8A |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low Cost HCMOS Microcontroller(低成本、8位HCMOS微控制器) |
| 中文描述： | 低成本HCMOS微控制器（低成本，8位HCMOS微控制器） |
| 文件頁數(shù)： | 170/196頁 |
| 文件大小： | 1118K |
| 代理商： | MC68HC05PV8A |
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Technical Data
Technical Data
MC68HC(8)05PV8/A
—
Rev. 1.9
170
Fast Parallel Interface
MOTOROLA
N
N
L
S
G
R
U
Figure 15-1 Basic Fast Peripheral Interface Timing
The basic timing as shown in
Figure 15-1
is similar to the timing used on
the HC11 parts in expanded multiplex mode. At the falling edge of the
address strobe signal (AS/PB0) the addresses on PA0
–
3, the read/write
signal (RW/PB1) and the chip select (CS/PB3) signal are valid. A high
DEN/PB2 signal indicates that data are driven on the bus in CPU write
cycles or that the peripheral IC can drive data in read cycles. Whenever
the FPICLK bit in the system control register is set the signals become
only active when the range from $0030
–
$003F is addressed by the CPU
thus significantly reducing electromagnetic noise.
When using the A/D converter in conjunction with the fast peripheral
interface the VRLEN bit of port A configuration register must be cleared.
See
7.4.4 Port A Configuration Register
.
PB0
PA0-3
A0
–
3
D0
–
3
RW
CS
PB1
PB2
PB3
AS
DEN
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