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參數資料
| 型號： | MC68HC12BE32 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-bit Microcontroller Units (MCUs)(16位微控制器) |
| 中文描述： | 16位微控制器單元（MCU）（16位微控制器） |
| 文件頁數： | 341/422頁 |
| 文件大?。?/td> | 3775K |
| 代理商： | MC68HC12BE32 |
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Byte Data Link Communications (BDLC)
BDLC Registers
MC68HC912B32 MC68HC12BE32 — Rev. 3.0
Advance Information
MOTOROLA
Byte Data Link Communications (BDLC)
341
NOTE:
The extra logic 1 bits are an enhancement to the J1850 protocol which
forces a byte boundary condition fault. This is helpful in preventing noise
onto the J1850 bus from a corrupted message.
TMIFR1 — Transmit Multiple Byte IFR with CRC Bit (Type 3)
The TMIFR1 bit requests the BDLC to transmit the byte in the BDLC
data register (BDR) as the first byte of a multiple byte IFR with CRC
or as a single byte IFR with CRC. Response IFR bytes are still subject
to J1850 message length maximums (see
15.8.2 J1850 Frame
Format
and
Figure 15-14
).
1 = If this bit is set prior to a valid EOD being received with no CRC
error, once the EOD symbol has been received, the BDLC
attempts to transmit the appropriate normalization bit followed
by IFR bytes. The programmer should set TEOD after the last
IFR byte has been written into the BDR. After TEOD has been
set and the last IFR byte has been transmitted, the CRC byte
is transmitted.
0 = The bit is cleared automatically, once the BDLC has
successfully transmitted the CRC byte and EOD symbol, by
thedetectionofanerroronthemultiplexbusorbyatransmitter
underruncausedwhentheprogrammerdoesnotwriteanother
byte to the BDR after the TDRE interrupt.
If the TMIFR1 bit is set, the BDLC attempts to transmit the
normalization symbol followed by the byte in the BDR. After the byte
in the BDR has been loaded into the transmit shift register, a TDRE
interrupt (see
15.10.3 BDLC State Vector Register
) occurs similar to
the main message transmit sequence. The programmer should then
load the next byte of the IFR into the BDR for transmission. When the
last byte of the IFR has been loaded into the BDR, the programmer
should set the TEOD bit in the BDLC control register 2 (BCR2). This
instructs the BDLC to transmit a CRC byte once the byte in the BDR
is transmitted, and then transmit an EOD symbol, indicating the end
of the IFR portion of the message frame.
However, to transmit a single byte followed by a CRC byte, the
programmer should load the byte into the BDR before the EOD
symbol has been received, and then set the TMIFR1 bit. Once the
TDRE interrupt occurs, the programmer sets the TEOD bit in the
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