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參數資料
| 型號： | MC88LV926DW |
| 廠商： | MOTOROLA INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | LOW SKEW CMOS PLL 68060 CLOCK DRIVER |
| 中文描述： | LVCMOS/LVTTL SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), PDSO20 |
| 封裝： | PLASTIC, SOIC-20 |
| 文件頁數： | 7/10頁 |
| 文件大?。?/td> | 108K |
| 代理商： | MC88LV926DW |
MC88LV926
TIMING SOLUTIONS
BR1333 — REV 5
7
MOTOROLA
2X_Q
Q0
Q1
Q2
Q3
QCLKEN
RST_OUT
SYNC
MR
PLL_EN
RST_IN
12.5MHz
CRYSTAL
OSCILLATOR
66MHz P–CLOCK OUT-
PUT
33MHz
B–CLOCK
AND SYSTEM
OUTPUTS
ANALOG GND
CL
VCC
1K
RST_OUT PIN
INTERNAL
LOGIC
Figure 3. RST_OUT Test Circuit
Figure 4. Logical Representation of the MC88LV926 With Input/Output Frequency Relationships
DELAY 33MHz CLKEN OUTPUT
Figure 5. Output/Input Switching Waveforms and Timing Relationships
SYNC Input
Q0–Q3 Outputs
2X_Q Output
QCLKEN
tCYCLE SYNC Input
tSKEWall
tSKEWf
tSKEWr
tSKEWf
tSKEWr
tCYCLE ‘Q’ Outputs
Timing Notes
1. The MC88LV926 aligns rising edges of the outputs and the SYNC input, therefore the SYNC input does not require a 50%
duty cycle.
2. All skew specs are measured between the VCC/2 crossing point of the appropriate output edges. All skews are specified as
‘windows’, not as a
±
deviation around a center point.
tSKEWQCLKEN
tSKEWQCLKEN
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PDF描述 |
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參數描述 |
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