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參數資料
| 型號： | PCM1804DBR |
| 英文描述： | FULL DIFFERENTIAL ANALOG INPUT 24-BIT, 192-kHz STEREO A/D CONVERTER |
| 中文描述： | 全差分模擬輸入24位，192千赫立體聲A / D轉換器 |
| 文件頁數： | 17/31頁 |
| 文件大小： | 470K |
| 代理商： | PCM1804DBR |
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PCM1804
SLES022A
–
DECEMBER 2001
17
www.ti.com
PRINCIPLES OF OPERATION
theory of operation (continued)
–
160
–
140
–
120
–
100
–
80
–
60
–
40
–
20
0
0
48
96
144
192
Single
Rate
Filter
Dual-Rate Filter
Quad-Rate Filter
Modulator
L
–
f
–
Frequency
–
kHz
Figure 31. Spectrum of Modulator Output and Decimation Filter
system clock input
The PCM1804 supports 128 f
S
, 192 f
S
(only master mode at quad rate), 256 f
S
, 384 f
S
, 512 f
S
, and 768 f
S
as
a system clock, where f
S
is the audio sampling frequency. The system clock must be supplied on SCKI (pin 18).
Table 1 shows the relationship of typical sampling frequency and the system clock frequency, and Figure 32
shows system clock timing. In master mode, the system clock rate is selected by OSR2 (pin 11), OSR1 (pin 10),
and OSR0 (pin 9) as shown in Table 1. In slave mode, the system clock rate is automatically detected. In DSD
mode, OSR2 (pin 11), OSR1 (pin 10), OSR0 (pin 9), and the system clock frequency are fixed as shown in
Table 1 and 3.
tw(SCKH)
tw(SCKL)
SCKI
SCKI
2 V
0.8 V
PARAMETER
MIN
UNIT
System clock pulse width high, tw(SCKH)
System clock pulse width low, tw(SCKL)
11
ns
11
ns
Figure 32. System Clock Input Timing
相關PDF資料 |
PDF描述 |
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參數描述 |
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