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參數(shù)資料
| 型號(hào)： | PSD301V-20JM |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 5015 RR 3#16S PIN RECPT |
| 中文描述： | 低成本現(xiàn)場(chǎng)可編程微控制器外圍設(shè)備 |
| 文件頁數(shù)： | 20/85頁 |
| 文件大?。?/td> | 691K |
| 代理商： | PSD301V-20JM |
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NOTE:
1. The expression for CSADOUT2 must include the following write operation cycle signals:
For CRRWR = 0, CSADOUT2 must include WR = 0.
For CRRWR = 1, CSADOUT2 must include E = 1 and R/W = 0.
PSD3XX Famly
17
INTERNAL
READ
CSADIN
INTERNAL
ALE
PA0–PA7
A11–A15
A16–A19
AD8–AD15
CSADOUT1
CSADOUT2
(1)
ALE or AS
AD0–AD7
RD/E
WR or R/W
CONTROL
DECODER
LATCH
PAD
I
O
NOTE:
1. CMOS/OD determines whether the output is open drain or CMOS.
READ PIN
PORT A PIN
ENABLE
LATCHED
ADDR OUT
MCU
I/O
OUT
ADn/Dn
READ DATA
WRITE DATA
ALE
READ DIR
WRITE DIR
RESET
CK
D
R
G
D
R
D
CK
R
CMOS/OD
(1)
I
N
T
E
R
N
A
L
A
D
D
R
/
D
A
T
A
B
U
S
A
D
0
/
A
D
7
DFF
LATCH
DIR
FF
CONTROL
MUX
10.2.2 Port A (PA0-PA7) in Non-Multiplexed Address/Data Mode
In this mode, Port A becomes the low-order data bus byte of the chip. When reading an
internal location, data is presented on Port A pins to the MCU. When writing to an internal
location, data present on Port A pins from the MCU is written to the desired location.
10.0
I/OPort
Functions
(
cont.)
Figure 5A. Port A Pin Structure
Figure 5B. Port A Track Mode
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PSD301V-25J | 5015 RR 6#16S SKT RECP |
| PSD301V-25JI | 5015 RR 3#16S SKT RECPT |
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| PSD301V-70J | Low Cost Field Programmable Microcontroller Peripherals |
| PSD301V-70JI | Low Cost Field Programmable Microcontroller Peripherals |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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