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參數資料
| 型號： | PSD833220MT |
| 廠商： | 意法半導體 |
| 英文描述： | High Speed CMOS Logic Dual Negative-Edge-Triggered J-K Flip-Flops with Reset 14-PDIP -55 to 125 |
| 中文描述： | Flash在系統可編程ISP的外設的8位微控制器 |
| 文件頁數： | 102/110頁 |
| 文件大小： | 1737K |
| 代理商： | PSD833220MT |
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PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
102/110
Figure 52. PLCC52 - 52-lead Plastic Lead, Chip Carrier Package Mechanical Drawing
Note: Drawing is not to scale.
Table 74. PLCC52 - 52-lead Plastic Lead, Chip Carrier Package Mechanical Dimensions
Symbol
mm
inches
Typ.
Min.
Max.
Typ.
Min.
Max.
A
4.19
4.57
0.165
0.180
A1
2.54
2.79
0.100
0.110
A2
–
0.91
–
0.036
B
0.33
0.53
0.013
0.021
B1
0.66
0.81
0.026
0.032
C
0.246
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0.0097
0.0103
D
19.94
20.19
0.785
0.795
D1
19.05
19.15
0.750
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D2
17.53
18.54
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E
19.94
20.19
0.785
0.795
E1
19.05
19.15
0.750
0.754
E2
17.53
18.54
0.690
0.730
e
1.27
–
–
0.050
–
–
R
0.89
–
–
0.035
–
–
N
52
52
Nd
13
13
Ne
13
13
PLCC-B
D
D1
E1 E
1 N
CP
b
D2/E2
e
b1
A1
A
A2
D3/E3
M
L1
L
C
M1
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PDF描述 |
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