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參數資料
| 型號： | PSD833220MT |
| 廠商： | 意法半導體 |
| 英文描述： | High Speed CMOS Logic Dual Negative-Edge-Triggered J-K Flip-Flops with Reset 14-PDIP -55 to 125 |
| 中文描述： | Flash在系統可編程ISP的外設的8位微控制器 |
| 文件頁數： | 52/110頁 |
| 文件大小： | 1737K |
| 代理商： | PSD833220MT |
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PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
52/110
Figure 26. General I/O Port Architecture
I
DATA OUT
REG.
D
Q
D
G
Q
D
Q
D
Q
WR
WR
WR
ADDRESS
MACROCELL OUTPUTS
ENABLE PRODUCT TERM (.OE)
EXT CS
ALE
READ MUX
P
D
B
CPLD-INPUT
CONTROL REG.
DIR REG.
INPUT
MACROCELL
ENABLE OUT
DATA IN
OUTPUT
SELECT
OUTPUT
MUX
PORT PIN
DATA OUT
ADDRESS
AI02885
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PDF描述 |
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