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參數(shù)資料
| 型號(hào)： | PSD913315MT |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
| 中文描述： | Flash在系統(tǒng)可編程ISP的外設(shè)的8位微控制器 |
| 文件頁(yè)數(shù)： | 31/110頁(yè) |
| 文件大小： | 1737K |
| 代理商： | PSD913315MT |
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31/110
PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
Figure 10. 8031 Memory Modules – Separate Space
Figure 11. 8031 Memory Modules – Combined Space
Table 13. VM Register
Bit 7
PIO_EN
Bit 6
Bit 5
Bit 4
Primary
FL_Data
Bit 3
Secondary
EE_Data
Bit 2
Primary
FL_Code
Bit 1
Secondary
EE_Code
Bit 0
SRAM_Code
0 = disable
PIO mode
not
used
not
used
0 = RD
can’t access
Flash memory
0 = RD can’t
access
Secondary Flash
memory
0 = PSEN
can’t access
Flash
memory
0 = PSEN can’t
access
Secondary Flash
memory
0 = PSEN
can’t access
SRAM
1= enable
PIO mode
not
used
not
used
1 = RD
access Flash
memory
1 = RD access
Secondary Flash
memory
1 = PSEN
access
Flash
memory
1 = PSEN access
Secondary Flash
memory
1 = PSEN
access
SRAM
Primary
Flash
Memory
DPLD
Secondary
Flash
Memory
SRAM
RS0
CSBOOT0-3
FS0-FS7
CS
CS
CS
OE
OE
RD
PSEN
OE
AI02869C
Primary
Flash
Memory
DPLD
Secondary
Flash
Memory
SRAM
RS0
CSBOOT0-3
FS0-FS7
RD
CS
CS
CS
RD
OE
OE
VM REG BIT 2
PSEN
VM REG BIT 0
VM REG BIT 1
VM REG BIT 3
VM REG BIT 4
OE
AI02870C
相關(guān)PDF資料 |
PDF描述 |
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| PSD913512JT | BBG ECL/TTL CLOCK DRVR; Package: 28 LEAD PLCC; No of Pins: 28; Container: Rail; Qty per Container: 37 |
| PSD913512MIT | PECL to TTL Clock Driver; Package: 28 LEAD PLCC; No of Pins: 28; Container: Tape and Reel; Qty per Container: 500 |
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