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參數(shù)資料
| 型號： | SY100EP11UZITR |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 100E SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| 封裝： | 0.150 INCH, SOIC-8 |
| 文件頁數(shù)： | 1/12頁 |
| 文件大?。?/td> | 121K |
| 代理商： | SY100EP11UZITR |
1
DESCRIPTION
FEATURES
2.5V/3.3V/5V 1:2 DIFFERENTIAL
PECL/LVPECL/ECL
FANOUT BUFFER
PIN CONFIGURATION/BLOCK DIAGRAM
1
2
3
45
6
7
8
Q0
Q1
VCC
D
VEE
/D
/Q0
/Q1
VEE
VCC
VEE
VCC
75k
75k
75k
VEE
8-pin MSOP and SOIC Packages
ECL Pro
SY10EP11U
SY100EP11U
FINAL
I 2.5V, 3.3V and 5V power supply options
I Guaranteed AC parameters over temperature:
f
MAX > 3.0GHz
< 20ps output-to-output skew
< 200ps t
r /tf
< 300ps propagation delay
I Wide temperature range: –40
°C to +85°C
I Available in 8-pin (3mm) MSOP and SOIC packages
The SY10/100EP11U is a precision, high-speed 1:2
differential fanout buffer. Having within-device skews and
output transition times significantly improved over the
EL11V, the EP11U is ideally suited for those applications
which require the ultimate in AC performance.
The differential inputs of the EP11U employ clamping
circuitry to maintain stability under open input conditions.
If the inputs are left open, the Q outputs will go LOW.
Rev.: C
Amendment: /0
Issue Date:
October 2002
Pin
Function
D
PECL, LVPECL, ECL, LVECL Clock or Data Input:
Internal 75k
pulldown resistor. If left floating,
pin defaults LOW, QOUT goes LOW.
/D
PECL, LVPECL, ECL, LVECL complementary
Clock or Data Input: Internal 75k
pull-up and
down resistors. If left open, default is VCC/2. When
the input is not used, it can be left open.
Q0, /Q0
PECL, LVPECL, ECL, LVECL Outputs:
Q1, /Q1
Terminates to VCC –2V.
VCC
Positive Power Supply: Bypass with 0.1
F//0.01F
low ESR capacitors.
VEE
Negative Power Supply: For PECL operation,
connect to GND.
PIN NAMES
Micrel Semiconductor
ON Semiconductor
SY10EP11UZI/KI
MC10EP11D/DT
SY10EP11UZI/KI
MC10LVEP11D/DT
SY100EP11UZI/KI
MC100EP11D/DT
SY100EP11UZI/KI
MC100LVEP11D/DT
CROSS REFERENCE TABLE
ECL Pro
ECL Pro is a trademark of Micrel, Inc.
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