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參數資料
型號: THS10082CDA
廠商: TEXAS INSTRUMENTS INC
元件分類: ADC
英文描述: 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
封裝: GREEN, PLASTIC, TSSOP-32
文件頁數: 21/37頁
文件大小: 375K
代理商: THS10082CDA
THS10082
SLAS254B MAY 2002 REVISED NOVEMBER 2002
www.ti.com
28
Read Timing Parameter (CS0-Controlled)(1)
PARAMETER
MIN
TYP
MAX
UNIT
tsu(R/W)
Setup time, R/W high to last CS valid
0
ns
ta
Access time, last CS valid to data valid
0
10
ns
td(CSDAV) Delay time, last CS valid to DATA_AV inactive
12
ns
th
Hold time, first CS invalid to data invalid
0
5
ns
th(R/W)
Hold time, first external CS invalid to R/W change
5
ns
tw(CS)
Pulse duration, CS active
10
ns
(1) CS = CS0
Write Timing (Using R/W, CS0-Controlled)
Figure 37 shows the write-timing behavior when the WR(R/W) input is programmed as a combined read-write input R/W.
The RD input has to be tied to high-level in this configuration. This timing is called CS0-controlled because CS0 is the last
external signal of CS0, CS1, and R/W which becomes valid.
90%
10%
tw(CS)
tsu(R/W)
th(R/W)
CS0
CS1
WR
RD
D(09)
DATA_AV
10%
tsu
th
Figure 37. Write Timing Diagram Using R/W (CS0-controlled)
Write Timing Parameter (CS0-Controlled)(1)
PARAMETER
MIN
TYP
MAX
UNIT
tsu(R/W)
Setup time, R/W stable to last CS valid
0
ns
tsu
Setup time, data valid to first CS invalid
5
ns
th
Hold time, first CS invalid to data invalid
2
ns
th(R/W)
Hold time, first CS invalid to R/W change
5
ns
tw(CS)
Pulse duration, CS active
10
ns
(1) CS = CS0
相關PDF資料
PDF描述
THS10082IDA 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
THS10082IDAR 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
THS10082IDAG4 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
THS1009CDAR 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
THS1009CDA 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
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參數描述
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