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參數資料
型號: THS10082CDA
廠商: TEXAS INSTRUMENTS INC
元件分類: ADC
英文描述: 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
封裝: GREEN, PLASTIC, TSSOP-32
文件頁數: 24/37頁
文件大小: 375K
代理商: THS10082CDA
THS10082
SLAS254B MAY 2002 REVISED NOVEMBER 2002
www.ti.com
30
Read Timing Parameter (RD-Controlled)
PARAMETER
MIN
TYP
MAX
UNIT
tsu(CS)
Setup time, RD low to last CS valid
0
ns
ta
Access time, last CS valid to data valid
0
10
ns
td(CSDAV) Delay time, last CS valid to DATA_AV inactive
12
ns
th
Hold time, first CS invalid to data invalid
0
5
ns
th(CS)
Hold time, RD change to first CS invalid
5
ns
tw(RD)
Pulse duration, RD active
10
ns
Write Timing (using WR, WR-Controlled)
Figure 39 shows the write-timing behavior when the WR(R/W) input is programmed as a write input WR only. The input
RD acts as the read input in this configuration. This timing is called WR-controlled because WR is the last external signal
of CS0, CS1, and WR which becomes valid.
90%
10%
tsu
th
D(09)
DATA_AV
10%
tw(WR)
tsu(CS)
th(CS)
CS0
CS1
WR
RD
Figure 39. Write Timing Diagram Using WR (WR-controlled)
Write Timing Parameter Using WR (WR-Controlled)
PARAMETER
MIN
TYP
MAX
UNIT
tsu(CS)
Setup time, CS stable to last WR valid
0
ns
tsu
Setup time, data valid to first WR invalid
5
ns
th
Hold time, WR invalid to data invalid
2
ns
th(CS)
Hold time, WR invalid to CS change
5
ns
tw(WR)
Pulse duration, WR active
10
ns
相關PDF資料
PDF描述
THS10082IDA 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
THS10082IDAR 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
THS10082IDAG4 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
THS1009CDAR 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
THS1009CDA 2-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PDSO32
相關代理商/技術參數
參數描述
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