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參數(shù)資料
| 型號： | TMX320C6413GTS |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Fixed-Point Digital Signal Processors |
| 中文描述： | 定點(diǎn)數(shù)字信號處理器 |
| 文件頁數(shù)： | 104/140頁 |
| 文件大小： | 1958K |
| 代理商： | TMX320C6413GTS |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁當(dāng)前第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁
Synchronous DRAM Timing
104
April 2004
Revised May 2005
SPRS247E
7.4
Synchronous DRAM Timing
Table 7
12. Timing Requirements for Synchronous DRAM Cycles for EMIFA Module (see Figure 7
12)
NO.
400
500
UNIT
MIN
2.1
2.5
MAX
6
7
t
su(EDV-EKO1H)
t
h(EKO1H-EDV)
Setup time, read AEDx valid before AECLKOUTx high
Hold time, read AEDx valid after AECLKOUTx high
ns
ns
Table 7
13. Switching Characteristics Over Recommended Operating Conditions for Synchronous DRAM
Cycles for EMIFA Module (see Figure 7
12
Figure 7
19)
NO.
PARAMETER
400
500
UNIT
MIN
1.3
MAX
6.4
6.4
1
2
3
4
5
8
9
10
11
12
13
t
d(EKO1H-CEV)
t
d(EKO1H-BEV)
t
d(EKO1H-BEIV)
t
d(EKO1H-EAV)
t
d(EKO1H-EAIV)
t
d(EKO1H-CASV)
t
d(EKO1H-EDV)
t
d(EKO1H-EDIV)
t
d(EKO1H-WEV)
t
d(EKO1H-RAS)
t
d(EKO1H-ACKEV)
t
d(EKO1H-PDTV)
Delay time, AECLKOUTx high to ACEx valid
Delay time, AECLKOUTx high to ABEx valid
Delay time, AECLKOUTx high to ABEx invalid
Delay time, AECLKOUTx high to AEAx valid
Delay time, AECLKOUTx high to AEAx invalid
Delay time, AECLKOUTx high to ASDCAS valid
Delay time, AECLKOUTx high to AEDx valid
Delay time, AECLKOUTx high to AEDx invalid
Delay time, AECLKOUTx high to ASDWE valid
Delay time, AECLKOUTx high to ASDRAS valid
Delay time, AECLKOUTx high to ASDCKE valid
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1.3
6.4
1.3
1.3
6.4
6.4
1.3
1.3
1.3
1.3
6.4
6.4
6.4
14
Delay time, AECLKOUTx high to PDT valid
1.3
6.4
ns
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