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參數(shù)資料
| 型號： | 74LVC74APW,118 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 2/19頁 |
| 文件大小： | 0K |
| 描述： | IC DUAL D-TYPE FLIP-FLOP 14TSSOP |
| 產(chǎn)品培訓(xùn)模塊： | Logic Packages |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | 74LVC |
| 功能： | 設(shè)置（預(yù)設(shè)）和復(fù)位 |
| 類型： | D 型 |
| 輸出類型： | 差分 |
| 元件數(shù)： | 2 |
| 每個元件的位元數(shù)： | 1 |
| 頻率 - 時鐘： | 250MHz |
| 延遲時間 - 傳輸： | 2.5ns |
| 觸發(fā)器類型： | 正邊沿 |
| 輸出電流高，低： | 24mA，24mA |
| 電源電壓： | 1.2 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 14-TSSOP（0.173"，4.40mm 寬） |
| 包裝： | 帶卷 (TR) |
74LVC74A
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NXP B.V. 2012. All rights reserved.
Product data sheet
Rev. 7 — 20 November 2012
10 of 19
NXP Semiconductors
74LVC74A
Dual D-type flip-flop with set and reset; positive-edge trigger
Measurement points are given in Table 9.
VOL and VOH are typical output voltage levels that occur with the output load.
Fig 8.
The set (nSD) and reset (nRD) input to output (nQ, nQ) propagation delays, the set and reset pulse
widths, and the nRD to nCP recovery time
mna423
trec
tPHL
tW
tPLH
VM
tW
VM
VI
GND
VI
GND
nSD input
VI
GND
nRD input
nCP input
VOH
VOL
nQ output
VOH
VOL
nQ output
Table 9.
Measurement points
Supply voltage
Input
Output
VCC
VI
VM
1.2 V
VCC
0.5
V
CC
0.5
V
CC
1.65 V to 1.95 V
VCC
0.5
V
CC
0.5
V
CC
2.3 V to 2.7 V
VCC
0.5
V
CC
0.5
V
CC
2.7 V
1.5 V
3.0 V to 3.6 V
2.7 V
1.5 V
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