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參數資料
| 型號： | AD9913 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | XO, clock |
| 英文描述： | Low Power 250 MSPS 10-Bit DAC 1.8 V CMOS Direct Digital Synthesizer |
| 中文描述： | 低功耗250 MSPS的10位DAC 1.8伏CMOS直接數字頻率合成器 |
| 文件頁數： | 25/32頁 |
| 文件大小： | 473K |
| 代理商： | AD9913 |
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AD9913
REGISTER MAP AND BIT DESCRIPTIONS
REGISTER MAP
Note that the highest number found in the Serial Bit Range column for each register in the following tables is the MSB and the lowest
number is the LSB for that register.
Rev. 0 | Page 25 of 32
Table 9. Control Registers
Register
Name
(Serial
Address)
CFR1—
Control
Function
Register 1
(0x00)
[Serial Bit
Range]/
Parallel
Address
[7:0]/0x00
MSB
Bit 7
External
Power-
Down
Mode
Clear
Auxiliary
Accum.
Bit 6
Digital
Power-
Down
Bit 5
DAC
Power-
Down
Bit 4
Clock
Input
Power-
Down
Bit 3
Load SRR @
IO_UPDATE
Bit 2
Autoclear
Auxiliary
Accum.
Bit 1
Autoclear
Phase
Accum.
LSB
Bit 0
Enable
Sine
Output
Default
Value
0x00
[15:8]/0x01
Clear
Phase
Accum.
Destination [1:0]
00: Frequency Word
01: Phase Word
Auxiliary
Accumulator
Enable
DC
Output
Active
Linear
Sweep
State
Trigger
Active
Open
Linear
Sweep
No-Dwell
Active
0x00
[23:16]/0x02
LSB First
Internal Profile Control [2:0]
Sync Clock
Disable
Open
Direct
Switch
Mode
Active
Open
0x00
[31:24]/0x03
Open
Open
Open
Modulus
Enable
Use Internal
Profile
Match
Pipe
Delays
Active
VCO2 Sel
Open
0x00
[7:0]/0x04
CMOS
Clock
Mode
PLL
Output
Div by 2
Crystal
Clock
Mode
PLL
Power-
Down
PLL LO
Range
PLL Input
Div by 2
PLL Reset
PLL Lock
0x32
CFR2—
Control
Function
Register 2
(0x01)
[15:8]/0x05
PLL Multiplication Factor [5:0]
Open
0x14
[7:0]/0x06
[15:8]/0x07
[23:16]/0x08
[31:24]/0x09
[7:0]/0x0A
[15:8]/0x0B
[23:16]/0x0C
[31:24]/0x0D
[7:0]/0x0E
[15:8]/0x0F
[7:0]/0x12
[15:8]/0x13
[23:16]/0x14
[31:24]/0x15
[39:32]/0x16
[47:40]/0x17
[55:48]/0x18
[63:56]/0x19
[7:0]/0x1A
[15:8]/0x1B
[23:16]/0x1C
[31:24]/0x1D
[39:32]/0x1E
[47:40]/0x1F
[55:48]/0x20
[63:56]/0x21
FS C [7:0]
0xFF
0x13
0x7F
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
Open
Open
Reserved
Open
FSC [9:8]
Reserved
Reserved
DAC Control
Register
(0x02)
Frequency Tuning Word [7:0]
Frequency Tuning Word [15:8]
Frequency Tuning Word [23:16]
Frequency Tuning Word [31:24]
Phase Offset Word [7:0]
FTW
(0x03)
POW
(0x04)
Open [1:0]
Phase Offset Word [13:8]
Sweep Parameter Word 0 [7:0]
Sweep Parameter Word 0 [15:8]
Sweep Parameter Word 0 [23:16]
Sweep Parameter Word 0 [31:24]
Sweep Parameter Word 1 [7:0]
Sweep Parameter Word 1 [15:8]
Sweep Parameter Word 1 [23:16]
Sweep Parameter Word 1 [31:24]
Rising Delta Word [7:0]
Rising Delta Word [15:8]
Rising Delta Word [23:16]
Rising Delta Word [31:24]
Falling Delta Word [7:0]
Falling Delta Word [15:8]
Falling Delta Word [23:16]
Falling Delta Word [31:24]
Linear Sweep
Parameter
Register
(0x06)
Linear Sweep
Delta
Parameter
Register
(0x07)
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PDF描述 |
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