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參數資料
| 型號： | ADF4252BCP-REEL7 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | XO, clock |
| 英文描述： | Dual Fractional-N/Integer-N Frequency Synthesizer |
| 中文描述： | PLL FREQUENCY SYNTHESIZER, 3000 MHz, QCC24 |
| 封裝： | MO-220-VGGD, LFCSP-24 |
| 文件頁數： | 17/28頁 |
| 文件大小： | 384K |
| 代理商： | ADF4252BCP-REEL7 |
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REV. B
ADF4252
–17–
Table VI. Master Register Map
P11
0
1
P12
0 XO ENABLED (REF
OUT
= REF
IN
)
1 XO DISABLED (REF
OUT
= LOGIC LOW)
(REF
OUT
= LOGIC HIGH WHEN IN POWER-DOWN)
P10
0
1
P9
0
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
LOGIC LOW
IF ANALOG LOCK DETECT
IF R DIVIDER OUTPUT
IF N DIVIDER OUTPUT
RF ANALOG LOCK DETECT
RF/IF ANALOG LOCK DETECT
IF DIGITAL LOCK DETECT
LOGIC HIGH
RF R DIVIDER OUTPUT
RF N DIVIDER OUTPUT
THREE-STATE OUTPUT
LOGIC LOW
RF DIGITAL LOCK DETECT
RF/IF DIGITAL LOCK DETECT
LOGIC HIGH
LOGIC LOW
DB10
DB9
DB8
DB7
DB6
DB5
DB4
DB3
DB2
DB1
DB0
C2 (1)
C1 (1)
P9
P10
P11
P12
M1
M2
M3
M4
CONTROL
BITS
MUXOUT
C3 (0)
X
D
P
D
C
S
C
R
MUXOUT
M1
M2
M3
M4
COUNTER RESET
DISABLED
ENABLED
CP THREE-STATE
DISABLED
THREE-STATE
POWER-DOWN
DISABLED
ENABLED
XO DISABLE
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PDF描述 |
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