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參數資料
| 型號： | ADSP-2100A |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | ADSP-2100 Family DSP Microcomputers |
| 中文描述： | 的ADSP - 2100系列DSP的微機 |
| 文件頁數： | 34/64頁 |
| 文件大小： | 668K |
| 代理商： | ADSP-2100A |
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ADSP-21xx
–34–
REV. B
TIMNGPARAMETERS (ADSP-2101/2105/2111/2115/2161/2163)
ME MORY WRIT E
13 MHz
Min
13.824 MHz 16.67 MHz
Min
Max
20 MHz
Min
25 MHz
Min
Parameter
Max
Min
Max
Max
Max
Unit
Switching Characteristic:
t
DW
Data Setup before WR High
t
DH
Data Hold after WR High
t
WP
WR Pulse Width
t
WDE
WR Low to Data Enabled
t
ASW
A0–A13, DMS, PMS Setup before
WR Low
t
DDR
Data Disable before WR or RD Low
t
CWR
CLKOUT High to WR Low
t
AW
A0–A13, DMS, PMS, Setup before WR
Deasserted
t
WRA
A0–A13, DMS, PMS Hold after WR
Deasserted
t
WWR
WR High to RD or WR Low
25.5
9.2
30.5
0
9.2
23.2
8.1
28.2
0
8.1
17
5
22
0
5
12
2.5
17
0
2.5
7
0
12
0
1.5
1
ns
ns
ns
ns
ns
9.2
14.2
35.7
8.1
13.1
32.2
5
10
23
2.5
7.5
15.5
1.5
1
5
8
ns
ns
ns
29.2
28.1
25
22.5
20
10.2
9.1
6
3.5
1
ns
33.5
31.2
25
20
15
ns
Figure 33. Memory Write
CLKOUT
A0 – A13
D
t
WRA
WR
DMS, PMS
t
WWR
t
WP
t
ASW
t
AW
t
CWR
RD
t
DH
t
DDR
t
WDE
t
DW
Frequency Dependency
(CLKIN
≤
25 MHz)
Min
Parameter
Max
Unit
Switching Characteristic:
t
DW
Data Setup before WR High
t
DH
Data Hold after WR High
t
WP
WR Pulse Width
t
WDE
WR Low to Data Enabled
t
ASW
A0–A13, DMS, PMS Setup before WR Low
t
DDR
Data Disable before WR or RD Low
t
CWR
CLKOUT High to WR Low
t
AW
A0–A13, DMS, PMS, Setup before WR
Deasserted
t
WRA
A0–A13, DMS, PMS Hold after WR
Deasserted
t
WWR
WR High to RD or WR Low
0.5t
CK
– 13 + w
0.25t
CK
– 10
0.5t
CK
– 8 + w
0
0.25t
CK
– 10
1
0.25t
CK
– 10
1
0.25t
CK
– 5
ns
ns
ns
ns
ns
ns
0.25t
CK
+ 10
0.75t
CK
– 22 + w
ns
0.25t
CK
– 9
0.5t
CK
– 5
ns
ns
NOT ES
1
For 25 MHz only the minimum frequency dependency formula for t
ASW
and t
DDR
= (0.25t
CK
– 8.5).
w = wait states
×
t
CK
.
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