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參數(shù)資料
| 型號： | ADSP-21060L |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | ADSP-2106x SHARC DSP Microcomputer Family |
| 中文描述： | 的ADSP - 2106x SHARC處理器DSP的微機家庭 |
| 文件頁數(shù)： | 1/47頁 |
| 文件大小： | 366K |
| 代理商： | ADSP-21060L |
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REV. D
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use, nor for any infringements of patents or other rights of third parties
which may result from its use. No license is granted by implication or
otherwise under any patent or patent rights of Analog Devices.
a
ADSP-2106x SHARC
DSP Microcomputer Family
ADSP-21060/ADSP-21060L
IEEE JTAG Standard 1149.1 Test Access Port and
On-Chip Emulation
240-Lead Thermally Enhanced MQFP Package
225 PBGA Package
32-Bit Single-Precision and 40-Bit Extended-Precision
IEEE Floating-Point Data Formats or 32-Bit Fixed-
Point Data Format
Parallel Computations
Single-Cycle Multiply and ALU Operations in Parallel
with Dual Memory Read/Writes and Instruction Fetch
Multiply with Add and Subtract for Accelerated FFT
Butterfly Computation
4 Mbit On-Chip SRAM
Dual-Ported for Independent Access by Core Processor
and DMA
Off-Chip Memory Interfacing
4 Gigawords Addressable
Programmable Wait State Generation, Page-Mode
DRAM Support
SHARC is a registered trademark of Analog Devices, Inc.
One Technology Way, P.O. Box 9106, Norwood, MA 02062-9106, U.S.A.
Tel: 781/329-4700
World Wide Web Site: http://www.analog.com
Fax: 781/326-8703
Analog Devices, Inc., 2000
SUMMARY
High Performance Signal Processor for Communica-
tions, Graphics, and Imaging Applications
Super Harvard Architecture
Four Independent Buses for Dual Data Fetch,
Instruction Fetch, and Nonintrusive I/O
32-Bit IEEE Floating-Point Computation Units—
Multiplier, ALU, and Shifter
Dual-Ported On-Chip SRAM and Integrated I/O
Peripherals—A Complete System-On-A-Chip
Integrated Multiprocessing Features
KEY FEATURES
40 MIPS, 25 ns Instruction Rate, Single-Cycle Instruction
Execution
120 MFLOPS Peak, 80 MFLOPS Sustained Performance
Dual Data Address Generators with Modulo and Bit-
Reverse Addressing
Efficient Program Sequencing with Zero-Overhead
Looping: Single-Cycle Loop Setup
DATA
REGISTER
FILE
16 40-BIT
BARREL
SHIFTER
ALU
MULTIPLIER
7
JTAG
TEST &
EMULATION
32
48
ADDR BUS
MUX
DATA BUS
MUX
MULTIPROCESSOR
INTERFACE
HOST PORT
EXTERNAL
PORT
4
6
6
36
IOP
REGISTERS
(MEMORY MAPPED)
CONTROL,
STATUS &
DATA BUFFERS
I/O PROCESSOR
LINK PORTS
(6)
SERIAL PORTS
(2)
DMA
CONTROLLER
IOA
17
IOD
48
ADDR
DATA
B
ADDR
DATA
ADDR
DATA
ADDR
DATA
TWO INDEPENDENT
DUAL-PORTED BLOCKS
PROCESSOR PORT
B
I/O PORT
DUAL-PORTED SRAM
24
32
48
40/32
PROGRAM
SEQUENCER
INSTRUCTION
CACHE
32 48-BIT
TIMER
BUS
CONNECT
(PX)
PM DATA BUS
DM DATA BUS
DM ADDRESS BUS
PM ADDRESS BUS
DAG1
8 4 32
DAG2
8 4 24
CORE PROCESSOR
Figure 1. Block Diagram
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-21060LAB-160 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21060KS-133 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21060KS-160 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21060LKB-160 | RES, 2.2 K SM CHIP 5% 50V 1/16 WATT, 0603 |
| ADSP-21060LKS-133 | ADSP-2106x SHARC DSP Microcomputer Family |
相關代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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