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參數(shù)資料
型號： ADSP-2109LKP-55
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號處理
英文描述： Low Cost DSP Microcomputers
中文描述： 24-BIT, 13.824 MHz, OTHER DSP, PQCC68
封裝： PLASTIC, LCC-68
文件頁數(shù)： 25/36頁
文件大?。?/td> 333K
代理商： ADSP-2109LKP-55
ADSP-2104/ADSP-2109
REV. 0
–25–
Frequency Dependency
(CLKIN
≤
20 MHz)
Min
Parameter
Max
Unit
Switching Characteristic:
t
DW
Data Setup before WR High
t
DH
Data Hold after WR High
t
WP
WR Pulse Width
t
WDE
WR Low to Data Enabled
t
ASW
A0–A13, DMS, PMS Setup before WR Low
t
DDR
Data Disable before WR or RD Low
t
CWR
CLKOUT High to WR Low
t
AW
A0–A13, DMS, PMS, Setup before WR
Deasserted
t
WRA
A0–A13, DMS, PMS Hold after WR
Deasserted
t
WWR
WR High to RD or WR Low
0.5t
CK
– 13 + w
0.25t
CK
– 10
0.5t
CK
– 8 + w
0
0.25t
CK
– 10
0.25t
CK
– 10
0.25t
CK
– 5
ns
ns
ns
ns
ns
ns
0.25t
CK
+ 10
0.75t
CK
– 22 + w
ns
0.25t
CK
– 9
0.5t
CK
– 5
ns
ns
TIMNGPARAMETERS (ADSP-2104/ADSP-2109)
ME MORY WRIT E
Min
20 MHz
Parameter
Max
Unit
Switching Characteristic:
t
DW
Data Setup before WR High
t
DH
Data Hold after WR High
t
WP
WR Pulse Width
t
WDE
WR Low to Data Enabled
t
ASW
A0–A13, DMS, PMS Setup before
WR Low
t
DDR
Data Disable before WR or RD Low
t
CWR
CLKOUT High to WR Low
t
AW
A0–A13, DMS, PMS, Setup before WR
Deasserted
t
WRA
A0–A13, DMS, PMS Hold after WR
Deasserted
t
WWR
WR High to RD or WR Low
12
2.5
17
0
2.5
ns
ns
ns
ns
ns
2.5
7.5
15.5
ns
ns
ns
22.5
3.5
ns
20
ns
Figure 23. Memory Write
CLKOUT
A0 – A13
D
WR
DMS, PMS
RD
t
WDE
t
DDR
t
DH
t
WWR
t
WRA
t
WP
t
DW
t
AW
t
CWR
t
ASW
相關(guān)PDF資料
PDF描述
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ADSP-2111BGZ-80 制造商:Analog Devices 功能描述:DSP FIX PT 16BIT 20MHZ 20MIPS 100CPGA - Trays
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