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參數(shù)資料
| 型號： | ADSP-2163BS-100 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 100V 1A ULTRA FAST LOW-LOSS CONTROLLED AVALANCHE RECTIFIER, SMA US1 SERIES, DO- |
| 中文描述： | 24-BIT, 25 MHz, OTHER DSP, PQFP80 |
| 封裝： | METRIC, PLASTIC, QFP-80 |
| 文件頁數(shù)： | 26/39頁 |
| 文件大小： | 243K |
| 代理商： | ADSP-2163BS-100 |
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REV. 0
ADSP-216x
–26–
TIMING PARAMETERS (ADSP-2161/ADSP-2163/ADSP-2165)
MEMORY WRITE
16.67 MHz
Min
20 MHz
Min
25 MHz
Min
Parameter
Max
Max
Max
Unit
Switching Characteristics:
t
DW
Data Setup Before
WR
High
t
DH
Data Hold After
WR
High
t
WP
WR
Pulsewidth
t
WDE
WR
Low to Data Enabled
t
ASW
A0–A13,
DMS
,
PMS
Setup Before
WR
Low
t
DDR
Data Disable Before
WR
or
RD
Low
t
CWR
CLKOUT High to
WR
Low
t
AW
A0–A13,
DMS
,
PMS
, Setup Before
WR
Deasserted
t
WRA
A0–A13,
DMS
,
PMS
Hold After
WR
Deasserted
t
WWR
WR
High to
RD
or
WR
Low
17
5
22
0
5
5
10
23
6
25
12
2.5
17
0
2.5
2.5
7.5
15.5
3.5
20
7
0
12
0
1.5
1
1.5
1
5
8
1
15
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
25
22.5
20
Frequency Dependency
(CLKIN
≤
25 MHz)
Parameter
Min
Max
Unit
Switching Characteristics:
t
DW
Data Setup Before
WR
High
t
DH
Data Hold After
WR
High
t
WP
WR
Pulsewidth
t
WDE
WR
Low to Data Enabled
t
ASW
A0–A13,
DMS
,
PMS
Setup Before
WR
Low
t
DDR
Data Disable Before
WR
or
RD
Low
t
CWR
CLKOUT High to
WR
Low
t
AW
A0–A13,
DMS
,
PMS
, Setup Before
WR
Deasserted
t
WRA
A0–A13,
DMS
,
PMS
Hold After
WR
Deasserted
t
WWR
WR
High to
RD
or
WR
Low
0.5t
CK
– 13 + w
0.25t
CK
– 10
0.5t
CK
– 8 + w
0
0.25t
CK
– 10
1
0.25t
CK
– 10
1
0.25t
CK
– 5
0.75t
CK
– 22 + w
0.25t
CK
– 9
0.5t
CK
– 5
ns
ns
ns
ns
ns
ns
ns
ns
ns
0.25t
CK
+ 10
NOTES
1
For 25 MHz only, the minimum frequency dependency formula for t
ASW
and t
DDR
= (0.25t
CK
– 8.5).
w = wait states
×
t
CK
.
CLKOUT
A0–A13
D
t
WP
t
AW
t
CWR
t
DH
t
WDE
t
DW
t
ASW
t
WWR
t
WRA
t
DDR
DMS
,
PMS
,
BMS
RD
WR
Figure 25. Memory Write
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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