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參數資料
| 型號： | ADSP-BF532SBBC400 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | Blackfin Embedded Processor |
| 中文描述： | 16-BIT, 40 MHz, OTHER DSP, PBGA160 |
| 封裝： | MO-205AE, CSBGA-160 |
| 文件頁數： | 27/56頁 |
| 文件大?。?/td> | 671K |
| 代理商： | ADSP-BF532SBBC400 |
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ADSP-BF531/ADSP-BF532/ADSP-BF533
Rev. 0
|
Page 27 of 56
|
March 2004
Parallel Peripheral Interface Timing
Table 20
and
Figure 15 on Page 27
describe Parallel Peripheral
Interface operations.
Table 20. Parallel Peripheral Interface Timing
Parameter
Timing Requirements
t
PCLKW
t
PCLK
t
SFSPE
t
HFSPE
t
SDRPE
t
HDRPE
Switching Characteristics - GP Output and Frame Capture Modes
t
DFSPE
Internal Frame Sync Delay After PPI_CLK
t
HOFSPE
Internal Frame Sync Hold After PPI_CLK
t
DDTPE
Transmit Data Delay After PPI_CLK
t
HDTPE
Transmit Data Hold After PPI_CLK
1
PPI_CLK frequency cannot exceed f
SCLK
/2
Min
Max
Unit
PPI_CLK Width
PPI_CLK Period
1
External Frame Sync Setup Before PPI_CLK
External Frame Sync Hold After PPI_CLK
Receive Data Setup Before PPI_CLK
Receive Data Hold After PPI_CLK
6.0
15.0
3.0
3.0
2.0
4.0
ns
ns
ns
ns
ns
ns
10.0
ns
ns
ns
ns
0.0
10.0
0.0
Figure 15. GP Output Mode and Frame Capture Timing
t
DDTPE
t
HDTPE
PPI_CLK
PPI_FS1
PPI_FS2
PPIx
DRIVE
EDGE
SAMPLE
EDGE
t
SFSPE
t
HFSPE
t
PCLKW
t
DFSPE
t
HOFSPE
t
SDRPE
t
HDRPE
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-BF532SBBZ400 | Blackfin Embedded Processor |
| ADSP-BF532SBST400 | 28-2 (14 Contacts) Pin Insert; For Use With:Amphenol MIL-C-5015 97 Series Circular Connectors; No. of Contacts:14; Gender:Male; Operating Voltage:1250V |
| ADSP-BF533 | Blackfin Embedded Processor |
| ADSP-BF533SBBC500 | Metal Connector Backshell |
| ADSP-BF533SBBZ500 | Blackfin Embedded Processor |
相關代理商/技術參數 |
參數描述 |
|---|---|
| ADSP-BF532SBBC400X | 制造商:Analog Devices 功能描述: |
| adsp-bf532sbb-c80 | 制造商:Analog Devices 功能描述: |
| adsp-bf532sbbc-c11 | 制造商:Analog Devices 功能描述: |
| adsp-bf532sbbc-dab | 制造商:Analog Devices 功能描述: |
| ADSPBF532SBBCENG | 制造商:Analog Devices 功能描述: |
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