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參數資料
型號: ADV7202
廠商: Analog Devices, Inc.
元件分類: Codec
英文描述: Simultaneous Sampling Video Rate Codec
中文描述: 同時采樣率視頻編解碼器
文件頁數: 7/26頁
文件大小: 216K
代理商: ADV7202
REV. PrB
PRELIMINARY TECHNICAL DATA
–7–
ADV7202
3.3 V SPECIFICATIONS
Parameter
Min
Typ
Max
Unit
Condition
2
PROGRAMMABLE GAIN
AMPLIFIER
Video ADC Gain
CLAMP CIRCUITRY
3
Clamp Off Leakage Current
Clamp Fine Source/Sink Current
Clamp Coarse Source/Sink Current
CLOCK CONTROL
4
DACCLK0/1
DACCLK1
DACCLK1
Clock High Time, t
10
(DACCLK0)
Clock Low Time, t
11
(DACCLK0)
Clock High Time, t
10
(DACCLK1)
Clock Low Time, t
11
(DACCLK1)
Data Setup Time, t
12
Data Hold Time, t
13
Pipeline Delay
5
, t
18
Video ADC
SAR
–6
+6
dB
Setup Conditions
TBD
μ
A
μ
A
mA
3
0.5
27
54
27
18
18
18
18
2
2
MHz
MHz
MHz
ns
ns
ns
ns
ns
ns
Dual CLK Dual Edge Mode
Single Edge Dual Clock Mode
4 : 2 : 2 Mode
Dual Edge Dual Clock Mode
All Input Modes
TBD
TBD
Clock Cycles
Clock Cycles
RESET CONTROL
RESET
Low Time
10
ns
NOTES
1
Temperature range T
MIN
to T
MAX
: 0
o
C to 70
o
C.
2
The max/min specifications are guaranteed over this range. The max/min values are typical over 3.15 V to 3.45 V range.
3
External clamp capacitor = 0.1
μ
F.
4
TTL input values are 0 V to 3 V, with input rise/fall times
3 ns, measured between the 10% and 90% points. Timing reference points at 50% for inputs and outputs.
Analog output load
10 pF.
5
Output delay measured from the 50% point of the rising edge of CLOCK to the 50% point of full-scale transition.
Specifications subject to change without notice.
(AVDD/DVDD = 3.3 V 5%, V
REF
= 1.235 V R
SET
= 1.2 k , all specifications T
MIN
to T
MAX1
unless otherwise noted.)
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