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參數(shù)資料
| 型號(hào)： | EPF10K30ATC144-3N |
| 廠商： | Altera |
| 文件頁數(shù)： | 51/128頁 |
| 文件大小： | 0K |
| 描述： | IC FLEX 10KA FPGA 30K 144-TQFP |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 180 |
| 系列： | FLEX-10K® |
| LAB/CLB數(shù)： | 216 |
| 邏輯元件/單元數(shù)： | 1728 |
| RAM 位總計(jì)： | 12288 |
| 輸入/輸出數(shù)： | 102 |
| 門數(shù)： | 69000 |
| 電源電壓： | 3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 144-LQFP |
| 供應(yīng)商設(shè)備封裝： | 144-TQFP（20x20） |
| 其它名稱： | 544-1943 EPF10K30ATC144-3N-ND |
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Altera Corporation
29
FLEX 10K Embedded Programmable Logic Device Family Data Sheet
I/O Element
An I/O element (IOE) contains a bidirectional I/O buffer and a register
that can be used either as an input register for external data that requires
a fast setup time, or as an output register for data that requires fast clock-
to-output performance. In some cases, using an LE register for an input
register will result in a faster setup time than using an IOE register. IOEs
can be used as input, output, or bidirectional pins. For bidirectional
registered I/O implementation, the output register should be in the IOE
and, the data input and output enable register should be LE registers
placed adjacent to the bidirectional pin. The Compiler uses the
programmable inversion option to invert signals from the row and
column interconnect automatically where appropriate. Figure 13 shows
the bidirectional I/O registers.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TAP686M010CRW-LF | CAP TANT 68UF 10V 20% RADIAL |
| VI-BNL-CW | CONVERTER MOD DC/DC 28V 100W |
| VI-BN4-CW | CONVERTER MOD DC/DC 48V 100W |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| EPF10K30ATI144-3 | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Flex 10K 216 LABs 102 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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| EPF10K30BC3563 | 制造商:ALTERA 功能描述:* |
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