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參數資料
型號： L9310
英文描述： Line Interface and Line Access Circuit Full-Feature SLIC,Ringing Relay,and Test Access Device
中文描述： 線路接口和線路接入電路全功能用戶接口，振鈴繼電器，測試接入設備
文件頁數： 48/60頁
文件大小： 1053K
代理商： L9310
Data Sheet
July 2001
Full-Feature SLIC, Ringing Relay, and Test Access Device
L9310 Line Interface and Line Access Circuit
48
Agere Systems Inc.
ac Applications
(continued)
First-Generation Codec ac Interface Network: Resistive Termination
(continued)
Example 1, Real Termination
(continued)
12-3521g (F)
Notes:
Termination impedance = 600
.
Hybrid balance = 600
.
Tx = 0 dBm.
Rx = 0 dBm.
Figure 16. Agere T7504 First-Generation Codec Resistive Termination, Nonmeter Pulse Application, Single
Battery Operation
R
G1
FUSIBLE
OR PTC
50
C
VBAT1
0.1
F
V
BAT1
RCVN
RTS
L9310
(GAIN OF 8)
OVH (DEFAULT OVERHEAD)
V
PROG
(I
LIMIT
= 40 mA)
V
BAT
FB2
C
F2
0.015
μ
F
LCF
CF1
VTX
RCVP
R
T3
140 k
R
RCV
100 k
R
HB1
100 k
VFXIN
R
X
100 k
GSX
V
FRO
DX
DR
FSE
FSEP
MCLK
ASEL
1/4 T7504
CODEC
CONTROL
INPUTS
PCM
HIGHWAY
SYNC
AND
CLOCK
–
+
ITR
PPMOUT
C
RTI
0.1
μ
F
PPMIN
AGND V
DD
+2.4 V
C
C2
0.1
μ
F
R
28.3 k
R
GP
43.2 k
1 M
50
R
RING
T
RING
100 V—130 V
SECONDARY
PROTECTOR
FUSIBLE
OR PTC
R
RTF
400
RINGING
SOURCE
C
CC
0.1
μ
F
V
CC
C
DD
0.1
μ
F
V
DD
A
D
C
TX
0.15
μ
F
R
GX
6.34 k
C
C1
0.33
μ
F
R
T6
49.9 k
RSW
PT
PWR
V
BAT2
/
V
CC
BGND
V
BAT1
TRGDET
ICM
DGND
TXI
TXN
VITR
180 V—330 V
SECONDARY
PROTECTOR
V
REF
B3
FB1
B2 B1 B0
V
REF
TESTLEV TESTSIG
CF2
MULTIPLEXED
DATA BUS
TO/FROM
MICROPROCESSOR
PER-LINE
TO/FROM
MICROPROCESSOR
PR
NSTAT RESET LATCH
R
VPROG
33.2 k
R
VREF
64.9 k
R
LCTH
59 k
LCTH (10 mA)
V
REF
V
REF
相關PDF資料
PDF描述
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