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參數資料
| 型號： | MAX5978ETJ+ |
| 廠商： | Maxim Integrated |
| 文件頁數： | 31/38頁 |
| 文件大小： | 2412K |
| 描述： | IC CTLR HOT-SWAP 32TQFN |
| 產品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 1 |
| 類型： | 熱交換控制器 |
| 應用： | 刀峰式服務器，網絡應用設備 |
| 內部開關： | 無 |
| 電流限制： | 可調 |
| 電源電壓： | 2.7 V ~ 16 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-WFQFN 裸露焊盤 |
| 供應商設備封裝： | 32-TQFN-EP（5x5） |
| 包裝： | 管件 |
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0 to 16V, Hot-Swap Controller with 10-Bit
Current, Voltage Monitor, and 4 LED Drivers
31
Fault Dependency
If a fault event occurs (digital UV warning/critical, digital
OV warning/critical, or digital overcurrent warning), the
fault is logged by setting a corresponding bit in registers
fault0, fault1, or fault2 (see Tables 46, 47, and 48).
Likewise, circuit-breaker shutdown events are logged in
register status0[7:0] (see Table 49).
IFAULTS indicates the overcurrent status from slow com-
parator. IFAULTF indicates overcurrent status from fast
comparator. The status of FAULT reflects the OR opera-
tion of IFAULTS and IFAULTF.
These fault register bits latch upon a fault condition, and
must be reset manually by restarting as described in the
Latched-Off Fault Management section.
Table 46. Undervoltage Status Register Format
Table 47. Overvoltage Status Register Format
Table 48. Overcurrent Warning Status Register Format
Table 49. Circuit-Breaker Event Logging Register Format
Description:
Undervoltage digital-compare status register (warning [0] and critical [4] undervoltage event-
detection status)
Register Title:
fault0
Register Address:
0x35
RESET
VALUE
R
R
R/C
R/C
R
R
R/C
R/C
Unused
uv1
Unused
uv1
0x00
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Description:
Overvoltage digital-compare status register (warning [0] and critical [4] overvoltage event-detection
status)
Register Title:
fault1
Register Address:
0x36
RESET
VALUE
R
R
R/C
R/C
R
R
R/C
R/C
Unused
ov2
Unused
ov1
0x00
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Description:
Overcurrent digital-compare status register (overcurrent warning event-detection status)
Register Title:
fault2
Register Address:
0x37
RESET
VALUE
R
R
R
R
R
R
R/C
R/C
Unused
oi
0x00
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Description:
Circuit-breaker slow- and fast-trip event logging
Register Title:
status0
Register Address:
0x31
RESET
VALUE
R
R
R
R
R
R
R
R
Unused
IFAULTS
Unused
IFAULTF
0x00
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
相關PDF資料 |
PDF描述 |
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參數描述 |
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