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參數(shù)資料
| 型號(hào)： | MC68EN360FE25 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | AC 4C 4#12 PIN PLUG 023 |
| 中文描述： | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CQFP240 |
| 封裝： | CERAMIC, QFP-240 |
| 文件頁(yè)數(shù)： | 822/962頁(yè) |
| 文件大小： | 2817K |
| 代理商： | MC68EN360FE25 |
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Electrical Characteristics
10-10
MC68360 USER’S MANUAL
MOTOROLA
10.9 BUS OPERATION AC TIMING SPECIFICATIONS (CONTINUED)
Num.
Characteristic
Symbol
3.3 V/5.0 V
25.0 MHz
Min
30
5.0V
Unit
33.34MHz
Min
Max
—
Max
—
21A11 R/
W
High to
CSˉ
Asserted
22
R/
W
Low to
DS
Asserted (Write)
tRACA
tRASA
tCHDO
ns
47
—
36
—
ns
23
CLKO1 High to Data-Out, Parity-Out Valid
—
23
—
15
ns
23A
CLKO1 High to parity Valid
t
CHPV
—
25
—
15
ns
23B
Parity Valid to CAS low
t
PVCL
tDVASN
3
—
3
—
ns
2412
Data-Out, Parity-Out Valid to Negating Edge of
AS
,
CSˉ,
WE
, (Fast Termination Write)
DS
,
CSˉ
,
WE
Negated to Data-Out, Parity-Out Invalid (Data-
Out, Parity-Out Hold)
25A13
CSˉ
Negated to Data-Out, Parity-Out Invalid (Data-Out, Par-
ity-Out Hold)
26
Data-Out, Parity-Out Valid to
DS
Asserted (Write)
10
—
7.5
—
ns
2512
tSNDOI
10
—
7.5
—
ns
tCNDOI
35
—
25
—
ns
tDVSA
tDICL
10
—
7.5
—
ns
2715
27B14 Data-In, Parity-In Valid to CLKO1 Low (Data Setup)
27A
Late
BERR
,
HALT
,
BKPT
Asserted to CLKO1 Low (Setup
Time)
2818
294
Parity-In Hold)
29A4
304
Hold)
30A4
315,15
DSACKˉ
Asserted to Data-In, Parity-In Valid
31A
DSACKˉ
Asserted to
DSACKˉ
Valid (Skew)
Data-In, Parity-In to CLKO1 Low (Data Setup)
1
—
1
—
ns
tDICL
20
—
15
—
ns
tBELCL
10
—
7.5
—
ns
AS
,
DS
Negated to
DSACKˉ
,
BERR
,
HALT
Negated
tSNDN
0
50
0
37.5
ns
DS
,
CSˉ, OE
Negated to Data-In, Parity-In Invalid (Data-In,
tSNDI
0
—
0
—
ns
DS
,
CSˉ, OE
Negated to Data-In High Impedance
tSHDI
—
40
—
30
ns
CLKO1 Low to Data-In, Parity-In Invalid (Fast Termination
tCLDI
10
—
7.5
—
ns
CLKO1 Low to Data-In High Impendance
tCLDH
—
60
—
45
ns
tDADI
—
32
—
24
ns
tDADV
tDADI
—
10
—
7.5
ns
31B5,14
DSACKˉ
Asserted to Data-In, Parity-In Valid
32
HALT
and
RESET
Input Transition Time
—
35
—
26
ns
tHRrf
tCLBA
tCLBN
tBRAGA
—
140
—
ns
33
CLKO1 High to
BG
Asserted
—
20
—
15
ns
34
CLKO1 High to
BG
Negated
—
20
22.5
15
ns
356
37
BR
Asserted to
BG
Asserted (
RMC
Not Asserted)
1
—
1
—
CLKO1
BGACK
Asserted to
BG
Negated
tGAGN
tGH
tGA
tRWA
tRWAS
tAIST
tAIHT
1
2.5
1
2.5
CLKO1
39
BG
Width Negated
2
—
2
—
CLKO1
39A
BG
Width Asserted
1
—
1
—
CLKO1
46
R/
W
Width Asserted (Write or Read)
100
—
75
—
ns
46A
R/
W
Width Asserted (Fast Termination Write or Read)
75
—
56
—
ns
47A
Asynchronous Input Setup Time
5
—
4
—
ns
47B
Asynchronous Input Hold Time
10
—
7.5
—
ns
相關(guān)PDF資料 |
PDF描述 |
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| MC68MH360FE25 | QUad Integrated Communications Controller Users Manual |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MC68EN360FE25C | 制造商:Motorola Inc 功能描述: |
| MC68EN360FE25V | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360FE33 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
| MC68EN360FS25C | 制造商:Motorola 功能描述:68EN360 S2C4B |
| MC68EN360RC25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:QUad Integrated Communications Controller Users Manual |
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