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參數資料
| 型號： | MT90500 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | Multi-Channel ATM AAL1 SAR(多通道 ATM AAL1分段及重組設備（基于通訊總線的系統與ATM網絡的接口）) |
| 中文描述： | 多通道自動柜員機AAL1特區（多通道自動柜員機AAL1分段及重組設備（基于通訊總線的系統與空中交通管理網絡的接口）） |
| 文件頁數： | 1/159頁 |
| 文件大小： | 514K |
| 代理商： | MT90500 |
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1
Features
AAL1 Segmentation and Reassembly device
compatible with Structured Data Transfer (SDT)
as per ANSI T1.630 and ITU I.363 standards
Transports 64kbps and N x 64kbps traffic over
ATM AAL1 cells (also over AAL5 or AAL0)
Simultaneous processing of up to 1024
bidirectional Virtual Circuits
Flexible aggregation capabilities (Nx64) to
allow any combination of 64 kbps channels
while maintaining frame integrity (DS0
grooming)
Support for clock recovery - Adaptive Clock
Recovery, Synchronous Residual Time Stamp
(SRTS), or external
Primary UTOPIA port (Level 1, 25 MHz) for
connection to external PHY devices with data
throughput of up to 155 Mbps
Secondary UTOPIA port for connection to an
external AAL5 SAR processor, or for chaining
multiple MT90500 devices
16-bit microprocessor port, configurable to
Motorola or Intel timing
TDM bus provides 16 bidirectional serial TDM
streams at 2.048, 4.096, or 8.192 Mbps for up
to 2048 TDM 64 kbps channels
Compatible with ST-BUS, MVIP, H-MVIP and
SCSA interfaces
Supports master and slave TDM bus clock
operation
Loopback function at TDM bus interface
Local TDM bus provides clocks, input pin and
output pin for 2.048 Mbps operation
Master clock rate up to 60 MHz
Dual rails (3.3V for power minimization, 5V for
standard I/O)
IEEE1149 (JTAG) interface
Figure A - MT90500 Block Diagram
External Memory Controller
Microprocessor
Interface
TDM
Clock
Logic
TDM Bus
Interface
TX
AAL1
SAR
Boundary Scan
TX
UTOPIA
MUX
RX
UTOPIA
VC
Lookup
Tables
TX / RX
External
Synchronous
SRAM
Clock Signals
TDM Bus
16 Lines
2048 x 64 kbps
(max.)
Local TDM Bus
32 x 64 kbps in
RX
AAL1
SAR
JTAG
Interface
16-bit Microprocessor Address
and Data Buses
Main
UTOPIA
Interface
Secondary
UTOPIA
Interface
To/From
External
PHY
From
External
ATM SAR
UTOPIA Module
Internal
TDM
Frame
Buffer
Registers
TDM Module
32 x 64 kbps out
Control Structures
and Circular Buffers
Clock
Recovery
DS5171
ISSUE 4
April 1999
MT90500
Multi-Channel ATM AAL1 SAR
Ordering Information
MT90500AL
240 Pin Plastic QFP
-40 to +85 C
相關PDF資料 |
PDF描述 |
|---|---|
| MT90500 | Multi-Channel ATM AAL1 SAR |
| MT90500AL | Multi-Channel ATM AAL1 SAR |
| MT90502 | Multi-Channel AAL2 SAR(多通道 ATM AAL2分段及重組設備（基于通訊總線的系統與ATM網絡的接口）) |
| MT90732AP | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT90732 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MT90500AL | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:Multi-Channel ATM AAL1 SAR |
| MT90500AL-ENG1 | 制造商:Mitel Networks Corporation 功能描述: |
| MT90502 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Multi-Channel AAL2 SAR |
| MT90502_06 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Multi-Channel AAL2 SAR |
| MT90502AG | 制造商:Rochester Electronics LLC 功能描述: 制造商:Zarlink Semiconductor Inc 功能描述: |
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