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參數資料
| 型號： | PSD854F2V-90 |
| 廠商： | 意法半導體 |
| 英文描述： | Flash In-System Programmable (ISP) Peripherals for 8-bit MCUs, 5V |
| 中文描述： | Flash在系統可編程（ISP）的周邊8位MCU，5V的 |
| 文件頁數： | 46/110頁 |
| 文件大小： | 1737K |
| 代理商： | PSD854F2V-90 |
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PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
46/110
80C31
Figure
21
shows the bus interface for the 80C31,
which has an 8-bit multiplexed address/data bus.
The lower address byte is multiplexed with the
data bus. The MCU control signals Program Se-
lect Enable (PSEN, CNTL2), Read Strobe (RD,
CNTL1), and Write Strobe (WR, CNTL0) may be
used for accessing the internal memory and I/O
Ports blocks. Address Strobe (ALE/AS, PD0)
latches the address.
Figure 21. Interfacing the PSD with an 80C31
EA/VP
X1
X2
RESET
RESET
INT0
INT1
T0
T1
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ADIO0
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ADIO11
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CNTL0(WR)
CNTL1(RD)
CNTL2(PSEN)
PD0-ALE
PD1
PD2
RESET
RD
WR
PSEN
ALE/P
TXD
RXD
RESET
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AD1
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PSD
80C31
AD7-AD0
AD[7:0]
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A8
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A12
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RD
WR
PSEN
ALE
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RESET
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AI02880C
相關PDF資料 |
PDF描述 |
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| PSD913212JT | Terminal Block; Pitch Spacing:0.197"; Wire Size (AWG):26-12; Mounting Type:PC Board; Leaded Process Compatible:No; Peak Reflow Compatible (260 C):No; Terminal Block Clamp Type:Tension Clamp |
相關代理商/技術參數 |
參數描述 |
|---|---|
| PSD854F2V-90J | 功能描述:CPLD - 復雜可編程邏輯器件 3.0V 2M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| PSD854F2V-90M | 功能描述:CPLD - 復雜可編程邏輯器件 3.0V 2M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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| PSD913212JIT | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
| PSD913212JT | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
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