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參數資料
| 型號： | Q67100-Q2776 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | BAG 5X8 SHIELDED ZIP LOCK |
| 中文描述： | 64兆位同步DRAM |
| 文件頁數： | 52/53頁 |
| 文件大小： | 418K |
| 代理商： | Q67100-Q2776 |
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HYB39S64400/800/160BT(L)
64MBit Synchronous DRAM
Semiconductor Group
51
21.2 CAS Latency = 3
~
terminate when the burst length is satisfied;
the burst counter increments and continues
Command
Bank B
bursting beginning with the starting address.
page address back to zero
during this time interval.
DQ
DQM
Addr.
AP
Bank B
from the highest order
The burst counter wraps
Command
Activate
Write
Command
Bank A
Bank A
Command
Activate
Z
Hi
DAx
DAx+1
RAx
RAx
CAx
DAx
~
3
DAx
+
DAx 2
~
~
DAx
-1
DAx 1
+
~
RBx
~
RBx
~
SPT03932
Data is
ignored.
Full Page burst operation does not
Write
Precharge
Command
Bank B
Burst Stop
Command
4
DBx
DBx
1
DBx
+
2
DBx
DBx
3
+
CBx
DBx+5
Command
Bank B
Activate
RBy
RBy
T8
BS
WE
CAS
RAS
CS
CKE
CLK
~
~
~
~
~
~
~
~
T3
High
T0
CK3
t
T1
T2
~
~
~
T4
~
T5
T6
T7
T18
T13
T9
T10
T11 T12
T15
T14
T16
T17
T20
T19
T21 T22
Burst Length = Full Page, CAS Latency = 3
相關PDF資料 |
PDF描述 |
|---|---|
| Q67100-Q2781 | BAG 6X10 SHIELDED ZIP LOCK |
| Q67100-Q2800 | BAG 8X10 SHIELDED ZIP LOCK |
| Q67100-H5001 | NONVOLATILE MEMORY 2-Kbit EEPROM WITH I2C BUS |
| Q67100-H6222 | ICs for Communications |
| Q67100-H6035 | ICs for Communications |
相關代理商/技術參數 |
參數描述 |
|---|---|
| Q67100-Q2781 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:64-MBit Synchronous DRAM |
| Q67100-Q2800 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:64-MBit Synchronous DRAM |
| Q67100-Q3016 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:4M x 36-Bit EDO-DRAM Module |
| Q67100-Q3017 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:4M x 36-Bit EDO-DRAM Module |
| Q67100-Q3018 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:8M x 36-Bit EDO-DRAM Module |
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