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參數資料
| 型號： | S29CD032J1JFAI122 |
| 廠商： | SPANSION LLC |
| 元件分類： | PROM |
| 英文描述： | 1M X 32 FLASH 2.7V PROM, 54 ns, PBGA80 |
| 封裝： | 13 X 11 MM, 1 MM PITCH, FORTIFIED, BGA-80 |
| 文件頁數： | 62/78頁 |
| 文件大小： | 1825K |
| 代理商： | S29CD032J1JFAI122 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁當前第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁
September 27, 2006 S29CD-J_CL-J_00_B1
S29CD-J & S29CL-J Flash Family
63
Pr el im i n a r y
Note: SA = sector address (for Sector Erase), VA = Valid Address for reading status data (see “Write Operation Status” ).
Figure 18.9 Chip/Sector Erase Operation Timings
Figure 18.10 Back-to-back Cycle Timings
OE#
CE#
Addresses
VCC
WE#
Data
2AAh
SA
tAH
tWP
tWC
tAS
tWPH
555h for chip erase
10 for Chip Erase
30h
tDS
tVCS
tCS
tDH
55h
tCH
In
Progress
Complete
tWHWH2
VA
Erase Command Sequence (last two cycles)
Read Status Data
RY/BY#
tRB
tBUSY
OE#
CE#
WE#
Addresses
tOH
Data
Valid
In
Valid
In
Valid PA
Valid RA
tWC
tWPH
tAH
tWP
tDS
tDH
tRC
tCE
Valid
Out
tOE
tACC
tOEH
tGHWL
tDF
Valid
In
CE# Controlled Write Cycles
WE# Controlled Write Cycle
Valid PA
tCP
tCPH
tWC
Read Cycle
tSR/W
tWPH
相關PDF資料 |
PDF描述 |
|---|---|
| S29CD032J1MFAN120 | 1M X 32 FLASH 2.7V PROM, 54 ns, PBGA80 |
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| S29CL016J0MFAI113 | 512K X 32 FLASH 3.3V PROM, 54 ns, PBGA80 |
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相關代理商/技術參數 |
參數描述 |
|---|---|
| S29CL016J0JQFM030 | 制造商:Spansion 功能描述:FLASH PARALLEL 3.3V 16MBIT 512KX32 54NS 80PQFP - Trays |
| S29CL016J0JQFM030P | 制造商:Spansion 功能描述:AUTO 3.3V 512KX32 FLASH - Trays |
| S29CL016J0JQFM030U | 制造商:Spansion 功能描述:32M (4MX8/2MX16) 3V REG, MIRRORBIT, TOP, FBGA48, IND - Trays |
| S29CL016J0JQFM03U | 制造商:Spansion 功能描述:32M (4MX8/2MX16) 3V REG, MIRRORBIT, TOP, FBGA48, IND - Trays |
| S29CL016J0MQFM030 | 制造商:Spansion 功能描述: |
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