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參數資料
| 型號： | TS83102G0BVGL |
| 廠商： | E2V TECHNOLOGIES PLC |
| 元件分類： | ADC |
| 英文描述： | 1-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, CBGA152 |
| 封裝： | 21 X 21 MM, 1.27 MM PITCH, CERAMIC, BGA-152 |
| 文件頁數： | 4/60頁 |
| 文件大小： | 1510K |
| 代理商： | TS83102G0BVGL |
第1頁第2頁第3頁當前第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁
12
0830E–BDC–06/07
TS83102G0B
e2v semiconductors SAS 2007
Note:
1. Unless otherwise specified
2. Refer to “Ordering Information” on page 55.
Only minimum and maximum values are guaranteed (typical values are issued from characterization results).
Figure 7-1.
Timing Diagram
Note:
Detailed timing diagrams are provided on page 38
Table 7-1.
Explanation of Test Levels
Level
Explanation
1
2
100% production tested at 25°C (1) and sample tested at specified temperatures (for "V" temperature ranges (2))
3
Sample tested only at specified temperatures
4
Parameter is guaranteed by design and characterization testing (thermal steady-state conditions at specified
temperature)
5
Parameter is a typical value guaranteed by design only
6
100% production tested over specified temperature range (for "B/Q" temperature range (2))
Pipeline Delay = 4 clock cycles
TOD
TD1 TD2
TDR
Gray to Binary decoding
Logic encoding
NN+1
N+2
NN+1
N+2
NN+1
N+2
NN+1
N+2
NN+1
N+2
NN+1
N+2
NN+1
N+2
NN+1
N+2
Latch 1
Latch 2
Latch 3
Latch 4
Latch 5
Latch 6
Latch 7
Latch 8
Data ready
Outputs
Internal clock
External clock
Analog input
Output
Latches
Regeneration
Latches
TA
N
N+1
相關PDF資料 |
PDF描述 |
|---|---|
| TS83102G0BCGL | 1-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, CBGA152 |
| TS83110CZT | 1-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, CDFP28 |
| TS83110MZT | 1-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, CDFP28 |
| TS83110VZT | 1-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, CDFP28 |
| TS83110MZB/T | 1-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, CDSO28 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TS83102G0CGL | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Analog to Digital Converter |
| TS83102G0GSZR5 | 制造商:e2v technologies 功能描述:TS83102G0GSZR5 - Trays |
| TS831-3I | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:MICROPOWER VOLTAGE SUPERVISOR RESET ACTIVE LOW |
| TS831-3ID | 功能描述:監控電路 2.71V Micropower AL RoHS:否 制造商:STMicroelectronics 監測電壓數: 監測電壓: 欠電壓閾值: 過電壓閾值: 輸出類型:Active Low, Open Drain 人工復位:Resettable 監視器:No Watchdog 電池備用開關:No Backup 上電復位延遲（典型值）:10 s 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:UDFN-6 封裝:Reel |
| TS831-3IDT | 功能描述:監控電路 2.71V Micropower AL RoHS:否 制造商:STMicroelectronics 監測電壓數: 監測電壓: 欠電壓閾值: 過電壓閾值: 輸出類型:Active Low, Open Drain 人工復位:Resettable 監視器:No Watchdog 電池備用開關:No Backup 上電復位延遲（典型值）:10 s 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:UDFN-6 封裝:Reel |
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