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參數資料
| 型號： | XC3S1200E-4FTG256C |
| 廠商： | Xilinx Inc |
| 文件頁數： | 202/227頁 |
| 文件大小： | 0K |
| 描述： | IC SPARTAN3E FPGA 1200K 256FTBGA |
| 標準包裝： | 90 |
| 系列： | Spartan®-3E |
| LAB/CLB數： | 2168 |
| 邏輯元件/單元數： | 19512 |
| RAM 位總計： | 516096 |
| 輸入/輸出數： | 190 |
| 門數： | 1200000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 256-LBGA |
| 供應商設備封裝： | 256-FTBGA |
| 其它名稱： | 122-1529 XC3S1200E-4FTG256C-ND |
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Spartan-3E FPGA Family: Functional Description
DS312 (v4.1) July 19, 2013
Product Specification
76
Figure 57, page 83 demonstrates how to configure multiple
FPGAs with different configurations, all stored in a single
SPI Flash. The diagram uses standard SPI Flash memories
but the same general technique applies for Atmel
DataFlash.
X-Ref Target - Figure 54
Figure 54: Atmel SPI-based DataFlash Configuration Interface
DS312-2_50a_082009
TDI
TDO
TMS
TCK
VCCINT
VCCAUX
+2.5V
CSO_B
VCCO_2
INIT_B
DIN
MOSI
PROG_B
DONE
GND
SI
CS
VCC
SO
SCK
GND
HSWAP
VCCO_0
P
CCLK
VCCO_0
Spartan-3E
FPGA
+2.5V
JTAG
Atmel
AT45DB
DataFlash
PROG_B
Recommend
open-drain
driver
TDI
TMS
TCK
TDO
+3.3V
RESET
‘1’
M2
M1
‘0’
M0
SPI Mode
‘1’
VS2
VS1
‘1’
VS0
Variant Select
‘0’
DOUT
WP
W
P
I
4.
7
k
+3.3V
4.
7
k
+2.5V
4.
7
k
33
0
‘1’
RDY/BUSY
+1.2V
Power-On
Monitor
+3.3V
Power-On
Monitor
+3.3V
or
Power-on monitor is only required if
+3.3V (VCCO_2) supply is the last supply
in power-on sequence, after VCCINT
and VCCAUX. Must delay FPGA
configuration for > 20 ms after SPI
DataFlash reaches its minimum VCC.
Force FPGA INIT_B input OR PROG_B
input Low with an open-drain or open-
collector driver.
INIT_B
PROG_B
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