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參數資料
| 型號： | AD9866BCPRL |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 通信及網絡 |
| 英文描述： | Broadband Modem Mixed Signal Front End |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, QCC64 |
| 封裝： | MO-220-VMMD, LFCSP-64 |
| 文件頁數： | 11/48頁 |
| 文件大小： | 1647K |
| 代理商： | AD9866BCPRL |
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AD9866
Pin No.
16
17, 64
18, 63
19
20
21
22
23
24
25–29
30
31, 34, 36, 39 44, 47, 48
32, 33
35, 40, 43
37, 38
41
42
45
46
49
50
51
52
53
Rev. 0 | Page 11 of 48
Mnemonic
RXCLK
DRVDD
DRVSS
CLKOUT1
SDIO
SDO
SCLK
SEN
GAIN
PGA[5]
PGA[4–0]
RESET
AVSS
REFB, REFT
AVDD
RX, RX+
REFADJ
REFIO
IOUT_G
IOUT_N
IOUT_G+
IOUT_N+
IOUT_P
IOUT_P+
MODE
Mode
1
HD
FD
FD
HD or FD
HD or FD
Pin Function
ADIO Request Clock Input
Rx and Tx Clock Output at 2 × f
ADC
Digital Output Driver Supply Input
Digital Output Driver Supply Return
f
DAC
/N Clock Output (L = 1, 2, 4, or 8)
Serial Port Data Input/Output
Serial Port Data Output
Serial Port Clock Input
Serial Port Enable Input
Tx Data Port (Tx[5:0]) Mode Select
MSB of PGA Input Data Port
Bits 4–0 of PGA Input Data Port
Reset Input (Active Low)
Analog Ground
ADC Reference Decoupling Nodes
Analog Power Supply Input
Receive Path and + Analog Inputs
TxDAC Full-Scale Current Adjust
TxDAC Reference Input/Output
Tx Amp Current Output_Sink
Tx Mirror Current Output_Sink
+Tx Amp Current Output_Sink
+Tx Mirror Current Output_Sink
TxDAC Current Output_Source
+TxDAC Current Output_Source
Digital Interface Mode Select Input
LOW = HD, HIGH = FD
Power-Up SPI Register Default Setting Input
Clock Osc./Synthesizer Supply Return
Crystal Osc. Inverter Output
Crystal Osc. Inverter Input
Clock Osc./Synthesizer Supply
Digital Supply Return
Digital Supply Input
f
OSCIN
/L Clock Output, (L = 1, 2, or 4)
Power-Down Input
54
55
56
57
58
59
60
61
62
CONFIG
CLKVSS
XTAL
OSCIN
CLKVDD
DVSS
DVDD
CLKOUT2
PWR_DWN
1
HD = half-duplex mode; FD = full-duplex mode.
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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