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參數資料
型號: ADSP-21266SKSTZ-2B
廠商: ANALOG DEVICES INC
元件分類: 數字信號處理
英文描述: SHARC Embedded Processor
中文描述: 16-BIT, 66.67 MHz, OTHER DSP, PQFP144
封裝: ROHS COMPLIANT, MS-026BFB, LQFP-144
文件頁數: 35/44頁
文件大小: 426K
代理商: ADSP-21266SKSTZ-2B
ADSP-21266
Rev. B
|
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|
May 2005
SPI Interface Protocol—Slave
See
Table 31
and
Figure 26
.
Table 31. SPI Interface Protocol—Slave
Parameter
Timing Requirements
t
SPICLKS
t
SPICHS
t
SPICLS
t
SDSCO
Min
Max
Unit
Serial Clock Cycle
Serial Clock High Period
Serial Clock Low Period
SPIDS Assertion to First SPICLK Edge
CPHASE = 0
CPHASE = 1
Last SPICLK Edge to SPIDS Not Asserted CPHASE = 0
Data Input Valid to SPICLK Edge (Data Input Setup Time)
SPICLK Last Sampling Edge to Data Input Not Valid
SPIDS Deassertion Pulse Width (CPHASE = 0)
4 × t
CCLK
2 × t
CCLK
– 2
2 × t
CCLK
– 2
ns
ns
ns
2 × t
CCLK
+ 1
2 × t
CCLK
+ 1
2 × t
CCLK
2
2
2 × t
CCLK
ns
ns
ns
ns
ns
ns
t
HDS
t
SSPIDS
t
HSPIDS
t
SDPPW
Switching Characteristics
t
DSOE
t
DSDHI
t
DDSPIDS
t
HDSPIDS
t
DSOV
SPIDS Assertion to Data Out Active
SPIDS Deassertion to Data High Impedance
SPICLK Edge to Data Out Valid (Data Out Delay Time)
SPICLK Edge to Data Out Not Valid (Data Out Hold Time)
SPIDS Assertion to Data Out Valid (CPHASE = 0)
0
0
5
5
7.5
ns
ns
ns
ns
ns
2 × t
CCLK
– 2
5 × t
CCLK
+ 2
Figure 26. SPI Interface Protocol—Slave
t
HSPIDS
t
DDSPIDS
t
DSDHI
LSB
MSB
MSB VALID
t
DSOE
t
DDSPIDS
t
HDSPIDS
MISO
(OUTPUT)
MOSI
(INPUT)
t
SSPIDS
SPIDS
(INPUT)
SPICLK
(CP = 0)
(INPUT)
SPICLK
(CP = 1)
(INPUT)
t
SDSCO
t
SPICHS
t
SPICLS
t
SPICLS
t
SPICLKS
t
HDS
t
SPICHS
t
SSPIDS
t
HSPIDS
t
DSDHI
LSB VALID
MSB
MSB VALID
t
DSOE
t
DDSPIDS
MISO
(OUTPUT)
MOSI
(INPUT)
t
SSPIDS
LSB VALID
LSB
CPHASE = 1
CPHASE = 0
t
SDPPW
t
DSOV
t
HDSPIDS
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PDF描述
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ADSP-21266SKSTZ-2D 功能描述:IC DSP 32BIT 150MHZ 144-LQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP(數字式信號處理器) 系列:SHARC® 標準包裝:2 系列:StarCore 類型:SC140 內核 接口:DSI,以太網,RS-232 時鐘速率:400MHz 非易失內存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA,FCBGA 供應商設備封裝:431-FCPBGA(20x20) 包裝:托盤
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