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參數資料
| 型號： | ADSP-21365 |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | 數字信號處理 |
| 英文描述： | SHARC Processor |
| 中文描述： | SHARC處理器 |
| 文件頁數： | 39/54頁 |
| 文件大?。?/td> | 559K |
| 代理商： | ADSP-21365 |
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ADSP-21365/6
Preliminary Technical Data
Rev. PrA
|
Page 39 of 54
|
September 2004
External PLL Mode
In External PLL Mode internal Digital PLL is disabled and the
receiver runs on the PLL that is connected to the processor
externally. This external PLL generates the 512 x Fs clock
(MCLK) from the reference clock (LRCLK) and gives it to
SPDIF receiver.
Table 35. SPDIF Receiver External PLL Mode Timing
Parameter
Timing Requirements
t
MCP
FMCLK
t
BDM
t
LDM
t
DDP
t
DDS
t
DDH
Min
Max
Unit
MCLK Period
MCLK Frequency (1/t
MCP
)
SCLK Propagation Delay from MCLK to the Falling Edge
LRCLK Propagation Delay From MCLK
Data Propagation Delay From MCLK
Data Output Setup To SCLK
Data Output Hold From SCLK
10
ns
MHz
ns
ns
ns
ns
ns
100
30
30
30
1/2 SCLK Period
1/2 SCLK Period
Figure 32. SPDIF Receiver External PLL Mode Timing
t
LDM
t
BDM
t
DDS
MSB
t
DDH
MCLKINPUT
(NOTTOSCALE)
BCLKOUTPUT
LRCLK
OUTPUT
SDATAOUTPUT
I2S-JUSTIFIED
MODE
t
DDP
t
DDS
t
DDH
t
DDP
MSB
LSB
t
DDH
t
DDS
SDATAOUTPUT
RIGHT-JUSTIFIED
MODE
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-21365SBBC-ENG | SHARC Processor |
| ADSP-21365SBBCZENG | SHARC Processor |
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相關代理商/技術參數 |
參數描述 |
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| ADSP-21365BSWZ-1AA | 功能描述:IC DSP 32BIT 333MHZ EPAD 144LQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數字式信號處理器） 系列:SHARC® 標準包裝:2 系列:StarCore 類型:SC140 內核 接口:DSI，以太網，RS-232 時鐘速率:400MHz 非易失內存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，FCBGA 供應商設備封裝:431-FCPBGA（20x20） 包裝:托盤 |
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| ADSP-21365KBCZ1AA | 制造商:Analog Devices 功能描述:DSP FLOATING PT 32BIT/40-BIT 333MHZ 333MIPS 136CSPBGA - Trays |
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