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參數資料
| 型號： | ADSP-21365SBBCZENG |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | SHARC Processor |
| 中文描述： | 16-BIT, 55.55 MHz, OTHER DSP, PBGA136 |
| 封裝： | LEAD FREE, MO-205AE, MBGA-136 |
| 文件頁數： | 22/54頁 |
| 文件大小： | 559K |
| 代理商： | ADSP-21365SBBCZENG |
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Rev. PrA
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September 2004
ADSP-21365/6
Preliminary Technical Data
Timer WDTH_CAP Timing
The following timing specification applies to Timer0, Timer1,
and Timer2 in WDTH_CAP (pulse width count and capture)
mode. Timer signals are routed to the DAI_P20–1 pins through
the SRU. Therefore, the timing specification provided below are
valid at the DAI_P20–1 pins.
DAI Pin to Pin Direct Routing
For direct pin connections only (for example DAI_PB01_I to
DAI_PB02_O).
Table 16. Timer Width Capture Timing
Parameter
Timing Requirement
t
PWI
Min
Max
Unit
Timer Pulse Width
2 t
PCLK
2(2
31
– 1) t
PCLK
ns
Figure 13. Timer Width Capture Timing
DAI_P20-1
(TIMER2-0)
t
PWI
Table 17. DAI Pin to Pin Routing
Parameter
Timing Requirement
t
DPIO
Min
Max
Unit
Delay DAI Pin Input Valid to DAI Output Valid
1.5
10
ns
Figure 14. DAI Pin to Pin Direct Routing
DAI_Pn
t
DPIO
DAI_Pm
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-21365SBSQ-ENG | SHARC Processor |
| ADSP-21365SKBCZENG | SHARC Processor |
| ADSP-21365SKSQZENG | SHARC Processor |
| ADSP-21366SKBCZENG | SHARC Processor |
| ADSP-21366SBBCZENG | SHARC Processor |
相關代理商/技術參數 |
參數描述 |
|---|---|
| ADSP-21365SBSQ-ENG | 制造商:AD 制造商全稱:Analog Devices 功能描述:SHARC Processor |
| ADSP-21365SBSQZENG | 制造商:AD 制造商全稱:Analog Devices 功能描述:SHARC Processor |
| ADSP-21365SCSQ-ENG | 制造商:AD 制造商全稱:Analog Devices 功能描述:SHARC Processor |
| ADSP-21365SCSQZENG | 制造商:AD 制造商全稱:Analog Devices 功能描述:SHARC Processor |
| ADSP-21365SKBC-ENG | 制造商:AD 制造商全稱:Analog Devices 功能描述:SHARC Processor |
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