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參數資料
| 型號： | ADT7482ARMZ-REEL |
| 廠商： | ON Semiconductor |
| 文件頁數： | 3/20頁 |
| 文件大小： | 282K |
| 描述： | IC SENSOR TEMP 2CH ALARM 10MSOP |
| 產品變化通告： | MFG CHG Notification ADI to ON Semi |
| 標準包裝： | 3,000 |
| 功能： | 溫度監控系統（傳感器） |
| 傳感器類型： | 內部和外部 |
| 感應溫度： | -40°C ~ 125°C，外部傳感器 |
| 精確度： | ±2.5°C（最小值） |
| 拓撲： | ADC，比較器，多路復用器，寄存器庫 |
| 輸出類型： | SMBus? |
| 輸出警報： | 是 |
| 輸出風扇： | 是 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 10-TFSOP，10-MSOP（0.118"，3.00mm 寬） |
| 供應商設備封裝： | 10-MSOP |
| 包裝： | 帶卷 (TR) |
ADT7482
http://onsemi.com
3
Table 3. PIN ASSIGNMENT
Pin No.
Mnemonic
Description
1
V
DD
Positive Supply, 3.0 V to 3.6 V.
2
D1+
Positive Connection to the First Remote (Remote 1) Temperature Sensor.
3
D1
Negative Connection to the First Remote (Remote 1) Temperature Sensor.
4
THERM
Open-Drain Output. This pin can be used to turn a fan on/off or throttle a CPU clock in the event of an
overtemperature condition. Requires pullup resistor.
5
GND
Supply Ground Connection.
6
D2
Negative Connection to the Second Remote (Remote 2) Temperature Sensor.
7
D2+
Positive Connection to the Second Remote (Remote 2) Temperature Sensor.
8
ALERT
/THERM2
Open-Drain Logic Output. This pin is used as interrupt or SMBus alert. May also be configured as a
second THERM
output. Requires pullup resistor.
9
SDATA
Logic Input/Output, SMBus Serial Data. Open-Drain Output. Requires pullup resistor.
10
SCLK
Logic Input, SMBus Serial Clock. Requires pullup resistor.
Table 4. TIMING SPECIFICATIONS (Note 1)
Parameter
Limit at T
MIN
and T
MAX
Unit
Description
f
SCLK
400
kHz max
t
LOW
1.3
ms min
Clock Low Period, between 10% Points
t
HIGH
0.6
ms min
Clock High Period, between 90% Points
t
R
300
ms max
Clock/Data Rise Time
t
F
300
ns max
Clock/Data Fall Time
t
SU;
STA
600
ms min
Start Condition Setup Time
t
HD;
STA
(Note 2)
600
ms min
Start Condition Hold Time
t
SU;
DAT
(Note 3)
100
ns min
Data Setup Time
t
SU;
STO
(Note 4)
600
ms min
Stop Condition Setup Time
t
BUF
1.3
ms min
Bus Free Time between Stop and Start Conditions
1. Guaranteed by design, not production tested.
2. Time from 10% of SDATA to 90% of SCLK.
3. Time for 10% or 90% of SDATA to 10% of SCLK.
4. Time for 90% of SCLK to 10% of SDATA.
Figure 2. Serial Bus Timing
STOP
START
t
SU; DAT
t
HIGH
t
F
t
HD; DAT
t
R
t
LOW
t
SU; STO
STOP START
SCLK
SDATA
t
BUF
t
HD; STA
t
HD; STA
t
SU; STA
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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