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參數資料
| 型號： | ADV7180BCPZ |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 顏色信號轉換 |
| 英文描述： | 10-Bit, 4 x Oversampling SDTV Video Decoder |
| 中文描述： | COLOR SIGNAL DECODER, QCC40 |
| 封裝： | 6 X 6 MM, ROHS COMPLIANT, MO-220VJJD-2, LFCSP-40 |
| 文件頁數： | 46/112頁 |
| 文件大小： | 1320K |
| 代理商： | ADV7180BCPZ |
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ADV7180
NVBEGDELO, NTSC VSYNC Begin Delay on Odd Field,
Address 0xE5 [7]
When NVBEGDELO is 0 (default), there is no delay.
Setting NVBEGDELO to 1 delays VSYNC going high on an odd
field by a line relative to NVBEG.
Rev. A | Page 46 of 112
For all NTSC/PAL VSYNC timing controls, both the V bit in
the AV code and the VSYNC on the VS pin are modified.
ADVANCE END OF
VSYNC BY NVEND[4:0]
DELAY END OF VSYNC
BY NVEND[4:0]
VSYNC END
NVENDSIGN
ODD FIELD
0
1
NO
YES
NVENDDELO
VSEHO
ADDITIONAL
DELAY BY
1 LINE
ADVANCE BY
0.5 LINE
1
0
1
0
NVENDDELE
VSEHE
ADDITIONAL
DELAY BY
1 LINE
ADVANCE BY
0.5 LINE
1
0
1
0
NOT VALID FOR USER
PROGRAMMING
0
ADVANCE BEGIN OF
VSYNC BY NVBEG[4:0]
DELAY BEGIN OF
VSYNC BY NVBEG[4:0]
VSYNC BEGIN
NVBEGSIGN
ODD FIELD
0
1
NO
YES
NVBEGDELO
VSBHO
ADDITIONAL
DELAY BY
1 LINE
ADVANCE BY
0.5 LINE
1
0
1
0
NVBEGDELE
VSBHE
ADDITIONAL
DELAY BY
1 LINE
ADVANCE BY
0.5 LINE
1
0
1
0
NOT VALID FOR USER
PROGRAMMING
0
Figure 36. NTSC Vsync End
NVENDDELO, NTSC Vsync End Delay on Odd Field,
Address 0xE6 [7]
When NVENDDELO is 0 (default), there is no delay.
Setting NVENDDELO to 1 delays vsync from going low on an
odd field by a line relative to NVEND.
NVENDDELE, NTSC Vsync End Delay on Even Field,
Address 0xE6 [6]
When NVENDDELE is set to 0 (default), there is no delay.
Setting NVENDDELE to 1 delays vsync from going low on an
even field by a line relative to NVEND.
NVENDSIGN, NTSC Vsync End Sign, Address 0xE6 [5]
Setting NVENDSIGN to 0 (default) delays the end of vsync.
Set for user manual programming.
Setting NVENDSIGN to 1 advances the end of vsync. Not
recommended for user programming.
Figure 35. NTSC Vsync Begin
NVBEGDELE, NTSC Vsync Begin Delay on Even Field,
Address 0xE5 [6]
When NVBEGDELE is 0 (default), there is no delay.
Setting NVBEGDELE to 1 delays vsync going high on an even
field by a line relative to NVBEG.
NVBEGSIGN, NTSC Vsync Begin Sign, Address 0xE5 [5]
Setting NVBEGSIGN to 0 delays the start of vsync. Set for user
manual programming.
Setting NVBEGSIGN to 1 (default) advances the start of vsync.
Not recommended for user programming.
NVBEG[4:0], NTSC Vsync Begin, Address 0xE5 [4:0]
The default value of NVBEG is 00101, indicating the NTSC
vsync begin position.
相關PDF資料 |
PDF描述 |
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參數描述 |
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