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參數資料
| 型號： | EFM32-TG840F32-SK |
| 廠商： | Energy Micro |
| 文件頁數： | 128/136頁 |
| 文件大小： | 0K |
| 描述： | IC MICRO KIT GECKO 64QFN |
| 標準包裝： | 1 |
| 系列： | Tiny Gecko |
| 套件類型： | 微控制器 |
| 值： | 2 件 - 閃存 - 32KB |
| 包裝： | 紙板盒 |
| 安裝類型： | 表面貼裝 |
| 包括封裝： | 64-QFN |
| 工具箱內容： | (2) 914-1036-2-ND - MCU 32BIT 32KB FLASH 64-QFN |
| 其它名稱： | 914-1020 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁當前第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁
...the world's most energy friendly microcontrollers
2011-02-04 - d0002_Rev1.00
91
www.energymicro.com
Table 4.6. ISPR bit assignments
Bits
Name
Function
[31:0]
SETPEND
Interrupt set-pending bits.
Write:
0 = no effect
1 = changes interrupt state to
pending.Read:
0 = interrupt is not pending
1 = interrupt is pending.
Note
Writing 1 to the ISPR bit corresponding to:
an interrupt that is pending has no effect
a disabled interrupt sets the state of that interrupt to pending.
4.2.5 Interrupt Clear-pending Registers
The ICPR0 and ICPR1 registers remove the pending state from interrupts, and show which interrupts
are pending. See:
the register summary in Table 4.2 (p. 88) for the register attributes
Table 4.3 (p. 89) for which interrupts are controlled by each register.
The bit assignments are:
CLRPEND bit s
31
0
Table 4.7. ICPR bit assignments
Bits
Name
Function
[31:0]
CLRPEND
Interrupt clear-pending bits.
Write:
0 = no effect
1 = removes pending state an
interrupt.Read:
0 = interrupt is not pending
1 = interrupt is pending.
Note
Writing 1 to an ICPR bit does not affect the active state of the corresponding interrupt.
4.2.6 Interrupt Active Bit Registers
The IABR0 and IABR1 registers indicate which interrupts are active. See:
the register summary in Table 4.2 (p. 88) for the register attributes
Table 4.3 (p. 89) for which interrupts are controlled by each register.
The bit assignments are:
相關PDF資料 |
PDF描述 |
|---|---|
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| 1267 X 6" | TAPE ALUMINUM FOIL 6" X 1FT |
相關代理商/技術參數 |
參數描述 |
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