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參數資料
| 型號： | EFM32-TG840F32-SK |
| 廠商： | Energy Micro |
| 文件頁數： | 133/136頁 |
| 文件大小： | 0K |
| 描述： | IC MICRO KIT GECKO 64QFN |
| 標準包裝： | 1 |
| 系列： | Tiny Gecko |
| 套件類型： | 微控制器 |
| 值： | 2 件 - 閃存 - 32KB |
| 包裝： | 紙板盒 |
| 安裝類型： | 表面貼裝 |
| 包括封裝： | 64-QFN |
| 工具箱內容： | (2) 914-1036-2-ND - MCU 32BIT 32KB FLASH 64-QFN |
| 其它名稱： | 914-1020 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁當前第133頁第134頁第135頁第136頁
...the world's most energy friendly microcontrollers
2011-02-04 - d0002_Rev1.00
96
www.energymicro.com
Bits
Name
Function
[2]
DISFOLD
When set to 1, disables IT folding. see Section 4.3.2.1 (p. 96) for more information.
[1]
DISDEFWBUF
When set to 1, disables write buffer use during default memory map accesses. This causes
all bus faults to be precise bus faults but decreases performance because any store to
memory must complete before the processor can execute the next instruction.
Note
This bit only affects write buffers implemented in the Cortex-M3 processor.
[0]
DISMCYCINT
When set to 1, disables interruption of load multiple and store multiple instructions. This
increases the interrupt latency of the processor because any LDM or STM must complete
before the processor can stack the current state and enter the interrupt handler.
4.3.2.1 About IT folding
In some situations, the processor can start executing the first instruction in an IT block while it is still
executing the IT instruction. This behavior is called IT folding, and improves performance, However, IT
folding can cause jitter in looping. If a task must avoid jitter, set the DISFOLD bit to 1 before executing
the task, to disable IT folding.
4.3.3 CPUID Base Register
The CPUID register contains the processor part number, version, and implementation information. See
the register summary in Table 4.12 (p. 94) for its attributes. The bit assignments are:
31
16 15
4 3
0
Im plem ent er
Revision
Part No
24 23
20 19
Variant
Const ant
Table 4.14. CPUID register bit assignments
Bits
Name
Function
[31:24]
Implementer
Implementer code:
0x41
= ARM
[23:20]
Variant
Variant number, the r value in the rnpn product revision identifier:
0x2
= r2pX
[19:16]
Constant
Reads as 0xF
[15:4]
PartNo
Part number of the processor:
0xC23
= Cortex-M3
[3:0]
Revision
Revision number, the p value in the rnpn product revision identifier:
0x0
= rXp0
0x1
= rXp1
4.3.4 Interrupt Control and State Register
The ICSR:
provides:
a set-pending bit for the Non-Maskable Interrupt (NMI) exception
set-pending and clear-pending bits for the PendSV and SysTick exceptions
indicates:
the exception number of the exception being processed
whether there are preempted active exceptions
the exception number of the highest priority pending exception
whether any interrupts are pending.
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