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參數(shù)資料
| 型號(hào)： | ISP1561BM |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | ISP1561BM |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP128 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-420-1, LQFP-128 |
| 文件頁數(shù)： | 54/102頁 |
| 文件大小： | 2875K |
| 代理商： | ISP1561BM |
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Philips Semiconductors
ISP1561
USB PCI host controller
Product data
Rev. 01 — 06 February 2003
54 of 102
9397 750 10015
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
11.1.16
HcFmNumber register (address: value read from func0 or func1 of address
10H
+
3CH)
This register is a 16-bit counter, and the bit allocation is given in
Table 72
. It provides
a timing reference among events happening in the Host Controller and the HCD. The
HCD may use the 16-bit value specified in this register and generate a 32-bit frame
number without requiring frequent access to the register.
Table 71:
Bit
31
HcFmRemaining register: bit description
Symbol
Description
FRT
FrameRemainingToggle:
This bit is loaded from the FIT
(FrameIntervalToggle) field of HcFmInterval whenever FR
(FrameRemaining) reaches 0. This bit is used by the HCD for the
synchronization between FI (FrameInterval) and FR.
-
reserved
FR[13:0]
FrameRemaining:
This counter is decremented at each bit time.
When it reaches 0, it is reset by loading the FI value specified in
HcFmInterval at the next bit time boundary. When entering the
USBOPERATIONAL state, the Host Controller re-loads the content
with the FI of HcFmInterval and uses the updated value from the
next SOF.
30 to 14
13 to 0
Table 72:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
HcFmNumber register: bit allocation
31
30
29
28
27
26
25
24
reserved
0
-
0
-
0
-
0
-
0
-
0
-
0
-
0
-
23
22
21
20
19
18
17
16
reserved
0
-
0
-
0
-
0
-
0
-
0
-
0
-
9
0
-
8
15
14
13
12
11
10
reserved
FN[13:8]
0
-
7
0
-
6
0
0
0
0
0
0
R/W
5
R/W
4
R/W
3
R/W
2
R/W
1
R/W
0
FN[7:0]
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
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PDF描述 |
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