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參數資料
| 型號： | ISP1561BM |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | ISP1561BM |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP128 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-420-1, LQFP-128 |
| 文件頁數： | 61/102頁 |
| 文件大小： | 2875K |
| 代理商： | ISP1561BM |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁當前第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁
Philips Semiconductors
ISP1561
USB PCI host controller
Product data
Rev. 01 — 06 February 2003
61 of 102
9397 750 10015
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
11.1.22
HcRhPortStatus[1:4] register (address: value read from func0 or func1 of
address 10H
+
54H)
The HcRhPortStatus[1:4] register is used to control and report port events on a
per-port basis. NumberDownstreamPorts represents the number of HcRhPortStatus
registers that are implemented in hardware. The lower word is used to reflect the port
status, whereas the upper word reflects the status change bits. Some status bits are
implemented with special write behavior. If a transaction (token through handshake)
is in progress when a write to change port status occurs, the resulting port status
change is postponed until the transaction completes. Reserved bits should always be
written logic 0. The bit allocation of the register is given in
Table 84
.
Table 84:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
HcRhPortStatus[1:4] register: bit allocation
31
30
29
28
27
26
25
24
reserved
0
-
0
-
0
-
0
-
0
-
0
-
0
-
0
-
23
22
21
20
19
18
17
16
CSC
0
R/W
8
PPS
0
R/W
0
CCS
0
R/W
reserved
0
-
14
PRSC
0
R/W
12
OCIC
0
R/W
11
PSSC
0
R/W
10
PESC
0
R/W
9
LSDA
0
R/W
1
PES
0
R/W
0
-
0
-
15
13
reserved
0
-
7
0
-
6
0
-
5
0
-
4
0
-
3
0
-
2
reserved
0
-
PRS
0
R/W
POCI
0
R/W
PSS
0
R/W
0
-
0
-
Table 85:
Bit
31 to 21
20
HCRhPortStatus[1:4] register: bit description
Symbol
Description
-
reserved
PRSC
PortResetStatusChange:
This bit is set at the end of the 10 ms
port reset signal. The HCD can write logic 1 to clear this bit.
Writing logic 0 has no effect.
0 —
port reset is not complete
1 —
port reset is complete
PortOverCurrentIndicatorChange:
This bit is valid only if
overcurrent conditions are reported on a per-port basis. This bit is
set when the Root Hub changes the POCI
(PortOverCurrentIndicator) bit. The HCD can write logic 1 to clear
this bit. Writing logic 0 has no effect.
19
OCIC
0 —
no change in PortOverCurrentIndicator
1 —
POCI has changed
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