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參數資料
| 型號： | L64005-F |
| 廠商： | LSI CORP |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP160 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁數： | 23/272頁 |
| 文件大小： | 1252K |
| 代理商： | L64005-F |
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L64005 MPEG-2 Audio/Video Decoder Technical Manual
3-3
Final Rev F
Copyright 1996 by LSI Logic Corporation. All rights reserved.
request and acknowledge pins. When operating with a system stream,
only one channel, the audio channel, is used. The device accepts MPEG
data from either a parallel or a serial stream. These modes are referred
to as parallel stream mode and serial stream mode.
The EPS bit in the Group 5 Control Register 0 selects either the serial
or parallel stream modes. See Section 2.7, “Group 5 Control Register,”
for details. The channel data is corrupted if the user switches modes dur-
ing normal operation.
A[2:0]
Address
Input
The address lines directly select one of eight internal reg-
ister banks.
AS
Address Strobe
Input
AS latches the address on the A[2:0] bus on the falling
edge.When transferring coded channel data to the
device, AS and the value on the Address bus are ignored.
VVALID and AVALID are used to indicate the target chan-
nel address.
CS
Chip Select
Input
CS is an active LOW chip select strobe input. During a
read cycle, CS must be LOW to access the on-chip data
registers. When CS is LOW, AVALID and VVALID must
be HIGH if they are used in parallel channel mode. The
controller can latch the data from the L64005 with the ris-
ing edge of CS. During a write cycle, CS must be
asserted LOW prior to data becoming valid from the con-
troller to the L64005. After the data has met the minimum
setup time, CS is deasserted HIGH to strobe the data
into the L64005. This signal should remain deasserted
HIGH during a parallel channel write.
D[7:0]
Host Data Bus
Bidirectional
The host uses the D[7:0] bidirectional data bus to pro-
gram the L64005 and access its internal state during
decoding. It is also used for parallel transfers of coded
MPEG data to the device.
INTR
Interrupt
Open Drain Output
INTR generates an interrupt to the host CPU. A pull-up
resistor is required for this signal.
相關PDF資料 |
PDF描述 |
|---|---|
| L64007 | SPECIALTY CONSUMER CIRCUIT, PQFP160 |
| L64013A1 | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| L64014A | SPECIALTY CONSUMER CIRCUIT, PQFP144 |
| L64015 | SPECIALTY CONSUMER CIRCUIT, PQFP144 |
| L64020XDC | SPECIALTY CONSUMER CIRCUIT, CBGA208 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| L64010ADC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
| L64010ADCC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
| L64010ADM | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
| L64010ADMB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
| L64010ADMC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Multiplier/Accumulator |
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